参数资料
型号: DS34S132GN+
厂商: Maxim Integrated Products
文件页数: 8/194页
文件大小: 0K
描述: IC TDM OVER PACKET 676-BGA
产品培训模块: Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
标准包装: 40
功能: TDM-over-Packet(TDMoP)
接口: TDMoP
电路数: 1
电源电压: 1.8V, 3.3V
工作温度: -40°C ~ 85°C
安装类型: 表面贴装
封装/外壳: 676-BGA
供应商设备封装: 676-PBGA(27x27)
包装: 管件
其它名称: 90-34S13+2N0
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DS34S132 DATA SHEET
19-4750; Rev 1; 07/11
105 of 194
JB. Field
Name
Addr (A:)
Bit [x:y] Type
Description
G10SRL. A:0228h
Group 10 Status Register Latch. Default: 0x00.00.00.00
RSVD
[31:8]
Reserved.
JBU
[87:80]
[7:0] rls-cor-i3
Jitter Buffer Underrun “1” = Jitter Buffer underrun. Bits [7:0] indicate Bundles
[87:80] respectively. This can also optionally indicate the start of playout.
G11SRL. A:022Ch
Group 11 Status Register Latch. Default: 0x00.00.00.00
RSVD
[31:8]
Reserved.
JBU
[95:88]
[7:0] rls-cor-i3
Jitter Buffer Underrun “1” = Jitter Buffer underrun. Bits [7:0] indicate Bundles
[95:88] respectively. This can also optionally indicate the start of playout.
G12SRL. A:0230h
Group 12 Status Register Latch. Default: 0x00.00.00.00
RSVD
[31:8]
Reserved.
JBU
[103:96]
[7:0] rls-cor-i3
Jitter Buffer Underrun “1” = Jitter Buffer underrun. Bits [7:0] indicate Bundles
[103:96] respectively. This can also optionally indicate the start of playout.
G13SRL. A:0234h
Group 13 Status Register Latch. Default: 0x00.00.00.00
RSVD
[31:8]
Reserved.
JBU
[111:104]
[7:0] rls-cor-i3
Jitter Buffer Underrun “1” = Jitter Buffer underrun. Bits [7:0] indicate Bundles
[111:104] respectively. This can also optionally indicate the start of playout.
G14SRL. A:0238h
Group 14 Status Register Latch. Default: 0x00.00.00.00
RSVD
[31:8]
Reserved.
JBU
[119:112]
[7:0] rls-cor-i3
Jitter Buffer Underrun “1” = Jitter Buffer underrun. Bits [7:0] indicate Bundles
[119:112] respectively. This can also optionally indicate the start of playout.
G15SRL. A:023Ch
Group 15 Status Register Latch. Default: 0x00.00.00.00
RSVD
[31:8]
Reserved.
JBU
[127:120]
[7:0] rls-cor-i3
Jitter Buffer Underrun “1” = Jitter Buffer underrun. Bits [7:0] indicate Bundles
[127:120] respectively. This can also optionally indicate the start of playout.
G16SRL. A:0240h
Group 16 Status Register Latch. Default: 0x00.00.00.00
RSVD
[31:8]
Reserved.
JBU
[135:128]
[7:0] rls-cor-i3
Jitter Buffer Underrun “1” = Jitter Buffer underrun. Bits [7:0] indicate Bundles
[135:128] respectively. This can also optionally indicate the start of playout.
G17SRL. A:0244h
Group 17 Status Register Latch. Default: 0x00.00.00.00
RSVD
[31:8]
Reserved.
JBU
[143:136]
[7:0] rls-cor-i3
Jitter Buffer Underrun “1” = Jitter Buffer underrun. Bits [7:0] indicate Bundles
[143:136] respectively. This can also optionally indicate the start of playout.
G18SRL. A:0248h
Group 18 Status Register Latch. Default: 0x00.00.00.00
RSVD
[31:8]
Reserved.
JBU
[151:144]
[7:0] rls-cor-i3
Jitter Buffer Underrun “1” = Jitter Buffer underrun. Bits [7:0] indicate Bundles
[151:144] respectively. This can also optionally indicate the start of playout.
G19SRL. A:024Ch
Group 19 Status Register Latch. Default: 0x00.00.00.00
RSVD
[31:8]
Reserved.
JBU
[159:152]
[7:0] rls-cor-i3
Jitter Buffer Underrun “1” = Jitter Buffer underrun. Bits [7:0] indicate Bundles
[159:152] respectively. This can also optionally indicate the start of playout.
G20SRL. A:0250h
Group 20 Status Register Latch. Default: 0x00.00.00.00
RSVD
[31:8]
Reserved.
JBU
[167:160]
[7:0] rls-cor-i3
Jitter Buffer Underrun “1” = Jitter Buffer underrun. Bits [7:0] indicate Bundles
[167:160] respectively. This can also optionally indicate the start of playout.
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