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参数资料
型号： DS34S132GN+
厂商： Maxim Integrated Products
文件页数： 167/194页
文件大小： 0K
描述： IC TDM OVER PACKET 676-BGA
产品培训模块： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
标准包装： 40
功能： TDM-over-Packet（TDMoP）
接口： TDMoP
电路数： 1
电源电压： 1.8V, 3.3V
工作温度： -40°C ~ 85°C
安装类型： 表面贴装
封装/外壳： 676-BGA
供应商设备封装： 676-PBGA（27x27）
包装： 管件
其它名称： 90-34S13+2N0
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DS34S132 DATA SHEET
19-4750; Rev 1; 07/11
74 of 194
10
DEVICE REGISTERS
10.1 Register Block Address Ranges
Table 10-1. Register Block Address Ranges
Registers
Address Range
Global Registers
Global Configuration Registers (G.)
0000h – 002Fh
Global Status Registers (G.)
0030h – 005Fh
Global Status Register Interrupt Enables (G.)
0060h – 007Fh
Individual Bundle and Jitter Buffer Registers
Global Bundle Reset Registers (B.)
0080h – 008Fh
Global Bundle Data Control Registers (B.)
0094h – 00A3h
Global Bundle Data Registers (B.)
00A4h – 00EFh
Bundle Group Status Latch Registers (B.)
0100h – 017Fh
Bundle Group Status Register Interrupt Enables (B.)
0180h – 01FFh
Jitter Buffer Status Registers (JB.)
0200h – 027Fh
Jitter Buffer Status Register Interrupt Enables (JB.)
0280h – 02FFh
Packet Classifier Registers
Packet Classifier Configuration Registers (PC.)
0300h – 035Fh
Packet Classifier Status Register Latches (PC.)
0360h – 0367h
Packet Classifier Status Register Interrupt Enables (PC.)
0368h – 036Fh
Packet Classifier Counter Registers (PC.)
0370h – 037Fh
SDRAM Interface and Access Registers
External Memory Interface Configuration Registers (EMI.)
0380h – 039Fh
External Memory Interface Status Registers (EMI.)
03A0h – 03AFh
External Memory Interface Status Register Interrupt Enables (EMI.)
03B0h – 03B7h
External Memory DLL/PLL Test Registers (EMI.)
03B8h – 03BFh
Write Registers (EMA.)
03C0h – 03DFh
Read Registers (EMA.)
03E0h – 03FFh
Test, Diagnostics and Clock Registers
Encap BERT Registers (EB.)
0400h – 043Fh
Decap BERT Registers (DB.)
0440h – 047Fh
Miscellaneous Diagnostic Registers (MD.)
0480h – 04AFh
Test Registers (TST.)
0600h – 067Fh
Clock Recovery Registers (CR.)
0800h – 0BFFh
Ethernet MAC Registers
MAC Registers (M.)
0C00h – 0DBFh
Per Port Registers
Port n TXP SW CAS Registers (TXSCn.; n = 0 to 31)
1000h – 11FFh
Port n Xmt (RXP) SW CAS Registers (RXSCn. ; n = 0 to 31)
1200h – 13FFh
Port n Transmit Configuration Registers (Pn.; n = 0 to 31)
2000h – 2FFFh
Port n Transmit Status Registers (Pn.; n = 0 to 31)
Port n Transmit Status Register Latches (Pn.; n = 0 to 31)
Port n Transmit Status Register Interrupt Enables (Pn.; n = 0 to 31)
Port n Receive Configuration Registers (Pn.; n = 0 to 31)
Port n Receive Status Registers (Pn.; n = 0 to 31)
Port n Receive Status Register Latches (Pn.; n = 0 to 31)
Port n Receive Status Register Interrupt Enables (Pn.; n = 0 to 31)
Time Slot Assignment Registers (TSAn.m.; n = 0 – 31; m = 0 – 31)
3000h – 4000h
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