参数资料
| 型号： | IP-SDI |
| 厂商： | Altera |
| 文件页数： | 100/140页 |
| 文件大小： | 0K |
| 描述： | IP VIDEO INTERFACE - SDI |
| 标准包装： | 1 |
| 系列： | * |
| 类型： | MegaCore |
| 功能： | 视频系统用串行数字接口 |
| 许可证： | 初始许可证 |
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4–12
Chapter 4: SDI Audio IP Cores
SDI Audio Extract MegaCore Function
Signals
MegaCore function.
Table 4–11. Clock Recovery Input and Output Signals
Signal
reset
fix_clk
Width
[0:0]
[0:0]
Direction
Input
Input
Description
This signal resets the system.
Assert this 200 MHz reference clock when you turn on the
Include Clock parameter.
The core asserts this 64 × sample rate clock (3.072 MHz
audio clock) when you turn on the Include Clock parameter.
aud_clk_out
[0:0]
Output
You use this clock to clock the audio interface in synchronous
mode.
As the core creates this clock digitally, it is prone to higher
levels of jitter.
aud_clk48_out
[0:0]
Output
The core asserts this sample rate clock when you turn on the
Include Clock parameter.
function.
Table 4–12. Video Input Signals
Signal
Width
Direction
Description
The video clock that is typically 27 MHz for SD-SDI,
vid_clk
[0:0]
Input
74.25 MHz or 74.17 MHz for HD-SDI, or 148.5 MHz
or 148.35 MHz for 3G-SDI standards. You can use
higher clock rates with the vid_datavalid signal.
Set this signal to 00b to indicate 10-bit SD-SDI
vid_std
[1:0]
Input
formats, 01b for 20-bit HD-SDI formats, 11b for 3G
Level A formats, and 10b for 3G-SDI Level B formats.
vid_datavalid
[0:0]
Input
Assert this signal when the video data is valid.
This signal carries luma and chroma information.
SD-SDI:
■
■
[19:10] Unused
[9:0] Cb,Y, Cr, Y multiplex
vid_data
[19:0]
Input
HD-SDI and 3G-SDI Level A:
■ [19:10] Y
[9:0] C
■
3G-SDI Level B:
■
■
[19:10] Cb,Y, Cr, Y multiplex (link A)
[9:0] Cb,Y, Cr, Y multiplex (link B)
vid_locked
[0:0]
Input
Assert this signal when the video is locked.
Serial Digital Interface (SDI) MegaCore Function
User Guide
February 2013 Altera Corporation
相关PDF资料 |
PDF描述 |
|---|---|
| IP-SDRAM/DDR2 | IP DDR2 SDRAM CONTROLLER |
| IP-SLITE2 | IP SERIALLITE II |
| IP-SRAM/QDRII | IP QDRII SRAM CONTROLLER |
| IP-VITERBI/SS | IP VITERBI LOW-SPEED |
| IP4220CZ6,125 | IC USB DUAL ESD PROTECT 6TSOP |
相关代理商/技术参数 |
参数描述 |
|---|---|
| IP-SDI-II | 功能描述:开发软件 SDI II Video MegaCore RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IP-SDRAM/DDR | 功能描述:开发软件 DDR SDRAM Control MegaCore RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IP-SDRAM/DDR2 | 功能描述:开发软件 DDR2 SDRAM Control MegaCore RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
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