参数资料
| 型号： | IP-SDI |
| 厂商： | Altera |
| 文件页数： | 53/140页 |
| 文件大小： | 0K |
| 描述： | IP VIDEO INTERFACE - SDI |
| 标准包装： | 1 |
| 系列： | * |
| 类型： | MegaCore |
| 功能： | 视频系统用串行数字接口 |
| 许可证： | 初始许可证 |
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Chapter 3: Functional Description
Block Description
Figure 3–12. Receiver Clocks
SD-SDI
3–23
Serial Data
SDI MegaCore
Function
rx_clk = 67.5 or 74 MHz
rx_data_valid_out
rx_clk
rx_data
V
V
V
V
rx_data_valid_out
67.5 MHz
HD-SDI
Serial Data
SDI MegaCore
Function
rx_clk = 74.175 or 74.25 MHz
rx_data_valid_out
rx_clk
rx_data
V
V
V
V
rx_data_valid_out
74.25 or 74.175 MHz
3G-SDI or Dual Standard or Triple Standard
Serial Data
SDI MegaCore
Function
rx_clk = 148.5 MHz (or 74.xx MHz when receiving HD)
rx_data_valid_out
148.5 MHz
Transmitter Transceiver Interface
Altera provides a transceiver interface, which interfaces the transceiver to the SDI
function. The transceiver interface implements the following functions:
■
■
■
Retiming from the parallel video clock domain to the transceiver transmitter clock
domain
Optional two-times oversampling for HD
Transmitter oversampling for SD
Transmitter Retiming
The txdata parallel data input to the transceiver must be synchronous and phase
aligned to the tx_coreclk transceiver clock input. SD-SDI (and optionally HD-SDI)
requires a retiming function, because of the oversampling logic. The transmitter uses a
small 16 × 20 FIFO buffer for the retiming.
For HD-SDI, the FIFO buffer realigns the parallel video input to the transceiver
tx_coreclk clock. It is written on every tx_pclk clock, and read on every tx_coreclk .
February 2013
Altera Corporation
Serial Digital Interface (SDI) MegaCore Function
User Guide
相关PDF资料 |
PDF描述 |
|---|---|
| IP-SDRAM/DDR2 | IP DDR2 SDRAM CONTROLLER |
| IP-SLITE2 | IP SERIALLITE II |
| IP-SRAM/QDRII | IP QDRII SRAM CONTROLLER |
| IP-VITERBI/SS | IP VITERBI LOW-SPEED |
| IP4220CZ6,125 | IC USB DUAL ESD PROTECT 6TSOP |
相关代理商/技术参数 |
参数描述 |
|---|---|
| IP-SDI-II | 功能描述:开发软件 SDI II Video MegaCore RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IP-SDRAM/DDR | 功能描述:开发软件 DDR SDRAM Control MegaCore RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IP-SDRAM/DDR2 | 功能描述:开发软件 DDR2 SDRAM Control MegaCore RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IP-SDRAM/DDR3 | 功能描述:开发软件 DDR3 SDRAM Control MegaCore RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IP-SDRAM/HPDDR | 功能描述:开发软件 DDR SDRAM Control MegaCore RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
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