参数资料
| 型号： | IP-SDI |
| 厂商： | Altera |
| 文件页数： | 64/140页 |
| 文件大小： | 0K |
| 描述： | IP VIDEO INTERFACE - SDI |
| 标准包装： | 1 |
| 系列： | * |
| 类型： | MegaCore |
| 功能： | 视频系统用串行数字接口 |
| 许可证： | 初始许可证 |
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3–34
Chapter 3: Functional Description
Block Description
ALTPLL_RECONFIG megafunction are connected.
Figure 3–22. Transceiver Dynamic Reconfiguration Block Diagram Using PLL Reconfiguration Mode
rom_address_out
write_rom_enable
pll_scandataout
pll_scandone
SDI IP Core - Receiver
ROM 3G
0
1
ALTPLL_RECONFIG
pll_areset
ALTGX_INST
ROM HD
write_from_rom
reconfig
rom_address_out
pll_configupdate
pll_scanclk
pll_scanclkena
pll_scandata
Protocol
rom_data_in
RECONFIG
Control Logic
sdi_start_reconfig
rx_std
User Logic
Encrypted RECO N FIG Megaf u nction
Encrypted SDI IP Core
The ALTPLL_RECONFIG block handles the programming of the ROM contents into
the transceiver megafunction. The ROM holds the transceiver setting information for
3G-SDI video standard. As the setup for SD-SDI is similar to 3G-SDI, only two
settings are required: one for SD-SDI and 3G-SDI, and one for HD-SDI.
The reconfiguration control logic selects the correct transceiver setting and also
provides the handshaking between the SDI MegaCore function and the
ALTPLL_RECONFIG block. The PLL reprogramming signals for the transceiver are
brought to the top-level interface of the SDI MegaCore function. This interface is only
available when you select Use PLL reconfiguration for transceiver dynamic
reconfiguration option in the SDI parameter editor. You must connect this interface
only to the ALTPLL_RECONFIG block.
Serial Digital Interface (SDI) MegaCore Function
User Guide
February 2013 Altera Corporation
相关PDF资料 |
PDF描述 |
|---|---|
| IP-SDRAM/DDR2 | IP DDR2 SDRAM CONTROLLER |
| IP-SLITE2 | IP SERIALLITE II |
| IP-SRAM/QDRII | IP QDRII SRAM CONTROLLER |
| IP-VITERBI/SS | IP VITERBI LOW-SPEED |
| IP4220CZ6,125 | IC USB DUAL ESD PROTECT 6TSOP |
相关代理商/技术参数 |
参数描述 |
|---|---|
| IP-SDI-II | 功能描述:开发软件 SDI II Video MegaCore RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IP-SDRAM/DDR | 功能描述:开发软件 DDR SDRAM Control MegaCore RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IP-SDRAM/DDR2 | 功能描述:开发软件 DDR2 SDRAM Control MegaCore RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IP-SDRAM/DDR3 | 功能描述:开发软件 DDR3 SDRAM Control MegaCore RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IP-SDRAM/HPDDR | 功能描述:开发软件 DDR SDRAM Control MegaCore RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
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