参数资料
| 型号： | IP-SDI |
| 厂商： | Altera |
| 文件页数： | 69/140页 |
| 文件大小： | 0K |
| 描述： | IP VIDEO INTERFACE - SDI |
| 标准包装： | 1 |
| 系列： | * |
| 类型： | MegaCore |
| 功能： | 视频系统用串行数字接口 |
| 许可证： | 初始许可证 |
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Chapter 3: Functional Description
3–39
Signals
3. Copy and modify the .mif files for the HD-SDI ROMs and edit word 23.
5. Run the Quartus II compilation.
For Arria II GX and Stratix IV devices, you must set the ROMs to use the fixed .mif in
the example\a2gx_tr\source\sdi_dprio_siv directory and compile once. Ensure that
you use the supporting reconfiguration code in the same directory for your design.
OpenCore Plus Time-Out Behavior
OpenCore Plus hardware evaluation can support the following two modes of
operation:
■
■
Untethered —the design runs for a limited time
Tethered —requires a connection between your board and the host computer. If
tethered mode is supported by all megafunctions in a design, the device can
operate for a longer time or indefinitely
All megafunctions in a device time out simultaneously when the most restrictive
evaluation time is reached. If there is more than one megafunction in a design, a
specific megafunction’s time-out behavior may be masked by the time-out behavior of
the other megafunctions.
1
For MegaCore functions, the untethered time-out is 1 hour; the tethered time-out
value is indefinite.
Your design stops working after the hardware evaluation time expires and the rst
signal goes high.
f For more information on OpenCore Plus hardware evaluation, refer to “OpenCore
Signals
Table 3–12. Receiver Clock Signals (Part 1 of 2)
Signal
gxb2_cal_clk
gxb4_cal_clk
rx_sd_oversample_clk_in
rx_serial_refclk (1)
rx_serial_refclk1
Direction
Input
Input
Input
Input
Input
Description
Calibration clock for Arria GX and Stratix II GX transceivers only.
Calibration clock for Arria II GX, Arria V, Cyclone IV GX,
HardCopy IV, and Stratix IV transceivers only.
67.5-MHz oversample clock input. SD-SDI only.
Transceiver training clock for HD-SDI, dual standard and triple
standard.
Secondary transceiver training clock. Clock frequency of
74.175 MHz for HD-SDI, or clock frequency of 148.35 MHz for
3G-SDI, dual standard and triple standard. Available only when you
use a Cyclone IV GX device.
February 2013
Altera Corporation
Serial Digital Interface (SDI) MegaCore Function
User Guide
相关PDF资料 |
PDF描述 |
|---|---|
| IP-SDRAM/DDR2 | IP DDR2 SDRAM CONTROLLER |
| IP-SLITE2 | IP SERIALLITE II |
| IP-SRAM/QDRII | IP QDRII SRAM CONTROLLER |
| IP-VITERBI/SS | IP VITERBI LOW-SPEED |
| IP4220CZ6,125 | IC USB DUAL ESD PROTECT 6TSOP |
相关代理商/技术参数 |
参数描述 |
|---|---|
| IP-SDI-II | 功能描述:开发软件 SDI II Video MegaCore RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IP-SDRAM/DDR | 功能描述:开发软件 DDR SDRAM Control MegaCore RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IP-SDRAM/DDR2 | 功能描述:开发软件 DDR2 SDRAM Control MegaCore RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IP-SDRAM/DDR3 | 功能描述:开发软件 DDR3 SDRAM Control MegaCore RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IP-SDRAM/HPDDR | 功能描述:开发软件 DDR SDRAM Control MegaCore RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
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