参数资料
| 型号： | IP-SDI |
| 厂商： | Altera |
| 文件页数： | 44/140页 |
| 文件大小： | 0K |
| 描述： | IP VIDEO INTERFACE - SDI |
| 标准包装： | 1 |
| 系列： | * |
| 类型： | MegaCore |
| 功能： | 视频系统用串行数字接口 |
| 许可证： | 初始许可证 |
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3–14
Chapter 3: Functional Description
Block Description
For SD-SDI operation, you can derive the transmitter reference clock from pclk by
using one of the Stratix GX PLLs. The PLL can multiply the 27-MHz pclk signal by
5/2.
For dual standard operation, use an external multiplexer to select between the SD-SDI
and HD-SDI reference clock.
The Stratix GX architecture allows each group of four transmitters (a transceiver
quad) to have a separate transmitter reference clock.
devices.
Table 3–5. Transmitter Clock Frequency—Stratix GX Devices
SD-SDI
Video Standard (1)
Clock Frequency (MHz)
67.5
HD-SDI (including dual link)
HD-SDI with two times oversample
74.175/74.25
148.35/148.5
Dual standard
67.5/74.175/74.25
(1) Stratix GX devices do not support 3G and triple standard modes.
(2) The tx_serial_refclk signal must be externally multiplexed.
Figure 3–8. Transmitter Clocks—Stratix GX Devices
SD-SDI
HD-SDI
Dual Standard
SDI MegaCore
Function
67.5 MHz
from PLL or Pin
SDI MegaCore
Function
74.XX MHz (1)
from reference clock
SDI MegaCore
Function
Serial Data
Serial Data
Serial Data
67.5 MHz
74.XX MHz (1)
(2)
(1) This frequency can be either 74.175 or 74.25 MHz, to support 1.4835 or 1.485 Gbps HD-SDI respectively.
(2) The multiplexer must not be in the device.
Serial Digital Interface (SDI) MegaCore Function
User Guide
February 2013 Altera Corporation
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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| IP-SDRAM/DDR2 | 功能描述:开发软件 DDR2 SDRAM Control MegaCore RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
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