参数资料
| 型号： | IP-SDI |
| 厂商： | Altera |
| 文件页数： | 61/140页 |
| 文件大小： | 0K |
| 描述： | IP VIDEO INTERFACE - SDI |
| 标准包装： | 1 |
| 系列： | * |
| 类型： | MegaCore |
| 功能： | 视频系统用串行数字接口 |
| 许可证： | 初始许可证 |
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Chapter 3: Functional Description
3–31
Block Description
ALT2GXB_RECONFIG megafunction are connected.
Figure 3–19. Transceiver Dynamic Reconfiguration for Receiver Block Diagram
SDI IP Core - Receiver
ROM (Hold MIF)
3G by default
ROM_CLK_ENABLE
ROM_ADDRESS
ALT2GXB
RECONFIG_INST
RECONFIG_TOGXB[2:0]
RECONFIG_FROMGXB[0]
ALT2GXB_INST
Protocol
if (ROM_ADDRESS = RX PMA)
HD: M, L value
0
3G/SD: M, L value
1
0
1
ROM_DATA_OUT
SDI IP Core - Duplex
RECONFIG Control
SDI_RECONFIG_DONE (1 )
ALT2GXB_INST
select_hd
and Intercept
User Logic
SDI_START_RECONFIG (1)
Protocol
RX_STD
SDI IP Core - Transmitter
ALT2GXB_INST
User Logic
Encrypted RECO N FIG Megaf u nction
Protocol
Encrypted SDI IP Core
(1) The SDI_START_RECONFIG and SDI_RECONFIG_DONE signals are not connected to the SDI MegaCore transmitter.
The ALT2GXB_RECONFIG block handles the programming of the ROM contents into
the transceiver megafunction. It performs data serialization and also handles
protection of certain data bits in the serial stream. You can only connect this block to
the reprogramming ports of the transceiver instance.
The ROM holds the transceiver setting information for the 3G-SDI video standard. As
the setup for SD-SDI is similar to 3G-SDI, only two settings are required: one for
SD-SDI and 3G-SDI, and one for HD-SDI.
The reconfiguration control and intercept user logic selects the correct transceiver
setting and also provides the handshaking between the SDI MegaCore function and
the ALT2GXB_RECONFIG block. The logic modifies the ROM read data when it reads
word 23 for all devices, barring Arria II GX and Stratix IV devices. For Arria II GX and
Stratix IV devices, the logic modifies the ROM read data when it reads word 29. For
examples, refer to the intercept logic,
example\s2gx_tr\source\sdi_dprio\sdi_mif_intercept.v and
example\a2gx_tr\source\sdi_dprio_siv\sdi_mif_intercept_siv.v .
February 2013
Altera Corporation
Serial Digital Interface (SDI) MegaCore Function
User Guide
相关PDF资料 |
PDF描述 |
|---|---|
| IP-SDRAM/DDR2 | IP DDR2 SDRAM CONTROLLER |
| IP-SLITE2 | IP SERIALLITE II |
| IP-SRAM/QDRII | IP QDRII SRAM CONTROLLER |
| IP-VITERBI/SS | IP VITERBI LOW-SPEED |
| IP4220CZ6,125 | IC USB DUAL ESD PROTECT 6TSOP |
相关代理商/技术参数 |
参数描述 |
|---|---|
| IP-SDI-II | 功能描述:开发软件 SDI II Video MegaCore RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IP-SDRAM/DDR | 功能描述:开发软件 DDR SDRAM Control MegaCore RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IP-SDRAM/DDR2 | 功能描述:开发软件 DDR2 SDRAM Control MegaCore RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IP-SDRAM/DDR3 | 功能描述:开发软件 DDR3 SDRAM Control MegaCore RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IP-SDRAM/HPDDR | 功能描述:开发软件 DDR SDRAM Control MegaCore RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
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