参数资料
| 型号： | IP-SDI |
| 厂商： | Altera |
| 文件页数： | 27/140页 |
| 文件大小： | 0K |
| 描述： | IP VIDEO INTERFACE - SDI |
| 标准包装： | 1 |
| 系列： | * |
| 类型： | MegaCore |
| 功能： | 视频系统用串行数字接口 |
| 许可证： | 初始许可证 |
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Chapter 2: Getting Started
2–13
Specifying Constraints
To specify the constraints, perform the following steps:
1. Parameterize and generate your SDI MegaCore functions—SDI triple standard
transmitter A, SDI triple standard transmitter B, SDI triple standard receiver A,
and SDI triple standard receiver B—with their unique starting channel number.
2. Edit the Tcl script so that the transceiver top-level reference clock matches the
name of the clock pin connected to SDI triple standard transmitter A, for example
tx_serial_refclk_top1 . Locate tx_serial_refclk_name in the script and change
to tx_serial_refclk_top1 .
3. Execute the Tcl script to patch the generated .sdc script with the new clock names.
1
A back-up copy of the .sdc script is created before the patch is made, and
any edits that were previously made to the .sdc script are preserved.
4. Execute the Tcl script in the Quartus II software, and perform the following steps:
a. On the Tools menu, click Tcl script.
b. Select the Tcl script of the instance SDI triple standard transmitter A, and click
Run.
5. Perform steps 2 to 4 for the other three instances.
Figure 2–5. Instantiating Multiple Channels of SDI Instances Sharing Multiple Reference Clocks
SYSTEM TOP LEVEL
Transceiver Bank 1
tx_serial_refclk_top1
SDI triple standard transmitter A
starting_channel_number = 0
SDI triple standard transmitter B
starting_channel_number = 8
SDI triple standard receiver A
starting_channel_number = 4
SDI triple standard receiver B
starting_channel_number = 12
rx_serial_refclk_top1
Transceiver Bank 2
tx_serial_refclk_top2
SDI triple standard transmitter A
starting_channel_number = 0
SDI triple standard transmitter B
starting_channel_number = 8
SDI triple standard receiver A
starting_channel_number = 4
SDI triple standard receiver B
starting_channel_number = 12
rx_serial_refclk_top2
To specify constraints for multiple channels of SDI MegaCore function with multiple
top-level reference clocks as shown in Figure 2–5 , perform the following steps:
1. For the SDI instances in Transceiver Bank 1, perform steps 1 to 5 you would do for
SDI instances sharing the same reference clock.
2. For the SDI instances in Transceiver Bank 2, duplicate an .sdc script for SDI triple
standard transmitter A and SDI triple standard receiver A in Transceiver Bank 2.
February 2013
Altera Corporation
Serial Digital Interface (SDI) MegaCore Function
User Guide
相关PDF资料 |
PDF描述 |
|---|---|
| IP-SDRAM/DDR2 | IP DDR2 SDRAM CONTROLLER |
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| IP-SRAM/QDRII | IP QDRII SRAM CONTROLLER |
| IP-VITERBI/SS | IP VITERBI LOW-SPEED |
| IP4220CZ6,125 | IC USB DUAL ESD PROTECT 6TSOP |
相关代理商/技术参数 |
参数描述 |
|---|---|
| IP-SDI-II | 功能描述:开发软件 SDI II Video MegaCore RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IP-SDRAM/DDR | 功能描述:开发软件 DDR SDRAM Control MegaCore RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IP-SDRAM/DDR2 | 功能描述:开发软件 DDR2 SDRAM Control MegaCore RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
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