参数资料
| 型号： | IP-SDI |
| 厂商： | Altera |
| 文件页数： | 111/140页 |
| 文件大小： | 0K |
| 描述： | IP VIDEO INTERFACE - SDI |
| 标准包装： | 1 |
| 系列： | * |
| 类型： | MegaCore |
| 功能： | 视频系统用串行数字接口 |
| 许可证： | 初始许可证 |
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Chapter 4: SDI Audio IP Cores
4–23
Instantiating the IP Cores
The start of packet, end of packet, and channel signals indicate the start of the audio
sample data and the associated audio channel.
For a single audio channel, the channel signal indicates channel 1 for all valid
samples. Figure 4–7 shows an example of a single audio channel.
Figure 4–7. Single Audio Channel
sop
eop
Audio data
header identifier
Audio data control packet
header identifier (LSB 4 bits)
data [23:0]
A
D0 D1 D2 D3 D4 D5 D6
D7 D8
D190 D191
E
V0 V1 V2 V3 V4 V5 V6 V7 U0 C4 C5 C6 C7
Audio sample data
Audio control data
channel
1
1
Single channel audio data
(Channel = 1)
For multiple channels, the Avalon-ST interface standard allows the packets to
interleave across the channels. By interleaving, the interface allows multiple audio
sources to be multiplexed and demultiplexed.
indicates either channel 1 or channel 2. Each channel has a start of packet and an end
of packet signal, which allows the channel interleaving and de-interleaving.
Figure 4–8. Multiple Audio Channel
sop
eop
Start of packet for audio
sample data channel 1
Start of packet for audio
sample data channel 1
End of packet for audio
sample data channel 1
End of packet for audio
sample data channel 2
Channel signal indicates
audio channel number
data
A
D0
A
D1
D188 D189 D2 D3 D190 D4 D191
D188 D189 D190 D191
E
Control data
E Control data
channel
1
2
1
1
2
1
2
1
2
1
2
Instantiating the IP Cores
You can instantiate the SDI Audio Embed and Audio Extract MegaCore functions the
following ways:
■
■
■
■
Instantiates within SOPC Builder with audio inputs exposed outside SOPC
Builder.
Instantiate within SOPC Builder with audio inputs exposed as Avalon-ST Audio
within SOPC Builder.
Directly instantiate in RTL with a CPU register interface.
Instantiate the encrypted core directly on RTL with control ports.
February 2013
Altera Corporation
Serial Digital Interface (SDI) MegaCore Function
User Guide
相关PDF资料 |
PDF描述 |
|---|---|
| IP-SDRAM/DDR2 | IP DDR2 SDRAM CONTROLLER |
| IP-SLITE2 | IP SERIALLITE II |
| IP-SRAM/QDRII | IP QDRII SRAM CONTROLLER |
| IP-VITERBI/SS | IP VITERBI LOW-SPEED |
| IP4220CZ6,125 | IC USB DUAL ESD PROTECT 6TSOP |
相关代理商/技术参数 |
参数描述 |
|---|---|
| IP-SDI-II | 功能描述:开发软件 SDI II Video MegaCore RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IP-SDRAM/DDR | 功能描述:开发软件 DDR SDRAM Control MegaCore RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IP-SDRAM/DDR2 | 功能描述:开发软件 DDR2 SDRAM Control MegaCore RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IP-SDRAM/DDR3 | 功能描述:开发软件 DDR3 SDRAM Control MegaCore RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IP-SDRAM/HPDDR | 功能描述:开发软件 DDR SDRAM Control MegaCore RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
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