参数资料
| 型号： | IP-SDI |
| 厂商： | Altera |
| 文件页数： | 123/140页 |
| 文件大小： | 0K |
| 描述： | IP VIDEO INTERFACE - SDI |
| 标准包装： | 1 |
| 系列： | * |
| 类型： | MegaCore |
| 功能： | 视频系统用串行数字接口 |
| 许可证： | 初始许可证 |
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A. Constraints
For the SDI MegaCore function to work reliably, you must implement the following
Quartus II constraints:
■
■
■
■
Specify clock characteristics
Set timing exceptions such as false path, maximum and minimum delays, and
multicycle path
Minimize the timing skew among the paths from I/O pins to the four sampling
registers
Set the oversampling clock that the oversampling interface to 135 MHz uses as an
independent clock domain
Specifying TimeQuest Timing Analyzer Constraints
To ensure your design meets timing and other requirements, you must constrain the
design. This section provides the necessary steps to properly constrain your SDI
design using the TimeQuest timing analyzer.
1. Make sure that TimeQuest is specified as the default timing analyzer in the Timing
Analysis Settings page of the Settings dialog box.
2. Perform initial compilation to create an initial design database before you specify
timing constraints for your design. On the Processing menu, click Start
Compilation . A message indicates when compilation is complete.
3. On the Tools menu, click TimeQuest Timing Analyzer .
4. Create timing netlist, double-click Create Timing Netlist in the Tasks pane. The
timing netlist appears in the Report pane.
5. Specify timing constraints and exceptions. To enter your timing requirements, you
can use constraint entry dialog boxes or edit the previously created .sdc file.
6. To save your constraints in an .sdc file, on the Constraints menu, click Write SDC
File .
February 2013
Altera Corporation
Serial Digital Interface (SDI) MegaCore Function
User Guide
相关PDF资料 |
PDF描述 |
|---|---|
| IP-SDRAM/DDR2 | IP DDR2 SDRAM CONTROLLER |
| IP-SLITE2 | IP SERIALLITE II |
| IP-SRAM/QDRII | IP QDRII SRAM CONTROLLER |
| IP-VITERBI/SS | IP VITERBI LOW-SPEED |
| IP4220CZ6,125 | IC USB DUAL ESD PROTECT 6TSOP |
相关代理商/技术参数 |
参数描述 |
|---|---|
| IP-SDI-II | 功能描述:开发软件 SDI II Video MegaCore RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IP-SDRAM/DDR | 功能描述:开发软件 DDR SDRAM Control MegaCore RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IP-SDRAM/DDR2 | 功能描述:开发软件 DDR2 SDRAM Control MegaCore RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IP-SDRAM/DDR3 | 功能描述:开发软件 DDR3 SDRAM Control MegaCore RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IP-SDRAM/HPDDR | 功能描述:开发软件 DDR SDRAM Control MegaCore RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
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