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参数资料
| 型号： | S5933QE |
| 厂商： | APPLIEDMICRO INC |
| 元件分类： | 总线控制器 |
| 英文描述： | PCI BUS CONTROLLER, PQFP160 |
| 封装： | PLASTIC, QFP-160 |
| 文件页数： | 100/176页 |
| 文件大小： | 823K |
| 代理商： | S5933QE |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页当前第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页
3-11
ARCHITECTURAL OVERVIEW
S5933
FIFOs
Two separate FIFO data paths exist within the
S5933. One FIFO handles data movement from the
PCI bus to the Add-On bus (shown in Figure 3) and
the other handles movement in the opposite direction
(Figure 4). Both of the FIFOs are able to support PCI
bus mastering; each has an address pointer and
transfer count register associated with its PCI bus
transaction. An important feature of the S5933 is the
ability to optionally perform various endian transla-
tions when data is moved through the FIFO. This
feature permits a single Add-On product to maintain
a fixed endian structure within the Add-On while al-
lowing the system platform to operate in its own na-
tive endian format.
Figure 3. PCI to Add-On FIFO Concept
Figure 4. Add-On to PCI FIFO Concept
READ ADDRESS
REGISTER (WHEN MASTER)
READ TRANSFER
COUNT (WHEN MASTER)
DATA
32
2
32
32 X 8
FIFO
PCI TRANSFER*
FIFO FLAGS
+ CONTROL
READ FIFO
EMPTY STATUS
ADD-ON
FIFO READ CONTROL
FULL STATUS
PCI
DATA
*PCI BUS MEMORY READ = S5933 FIFO WRITE
WHEN S5933 IS BUS MASTER
+1
-1
26 BIT
COUNTER
ZERO DECODE
(STOP)
PCI INTERRUPT
ADD-ON INTERRUPT
PCI
ADDRESS
ENDIAN
CONVERSION
COUNTER
PCI
BUS
INTERFACE
ADD-ON
INTERFACE
WRITE ADDRESS
REGISTER (WHEN MASTER)
WRITE TRANSFER
COUNT (WHEN MASTER)
DATA
32
32 X 8
FIFO
PCI TRANSFER*
FIFO FLAGS
+ CONTROL
WR FULL
ADD-ON
FIFO WRITE
EMPTY
PCI
DATA
*PCI BUS MEMORY WRITE = S5933 FIFO READ
WHEN S5933 IS BUS MASTER
+1
26 BIT
COUNTER
ZERO DECODE
(STOP)
PCI INTERRUPT
ADD-ON INTERRUPT
PCI
ADDRESS
COUNTER
-1
2
PCI
BUS
INTERFACE
ADD-ON
INTERFACE
ENDIAN
CONVERSION
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