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参数资料
| 型号： | S5933QE |
| 厂商： | APPLIEDMICRO INC |
| 元件分类： | 总线控制器 |
| 英文描述： | PCI BUS CONTROLLER, PQFP160 |
| 封装： | PLASTIC, QFP-160 |
| 文件页数： | 161/176页 |
| 文件大小： | 823K |
| 代理商： | S5933QE |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页当前第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页
3-97
PCI BUS INTERFACE
S5933
Master Abort
PCI accesses to nonexistent or disabled targets
never observe DEVSEL# being asserted. In this situ-
ation, it is necessary for the initiator to abort the
transaction (master abort). As an initiator, S5933
waits for six clock periods after asserting FRAME# to
determine whether a master abort is required. These
six clock periods allow slow targets, which may re-
quire several bus clocks before being able to assert
DEVSEL#, to respond. It is also possible a PCI
bridge device is present which employs “subtractive”
decoding. A device which does a subtractive decode
asserts DEVSEL#, claiming the cycle, when it sees
that no other device has asserted it three clocks after
the address phase.
If DEVSEL# is not asserted, the S5933 deasserts
FRAME# (if asserted) upon the sixth clock period
(Figure 9). IRDY# is deasserted by the S5933 during
the next clock. The occurrence of a master abort
causes the S5933 to set bit 13 (Master Abort) of the
PCI Status Register, indicating an error condition.
Target-Initiated Termination
There are situations where the target may end a
transfer prematurely. This is called “target-initiated
termination.” Target terminations fall into three cat-
egories: disconnect, retry, and target abort. Only the
disconnect termination completes a data transfer.
Figure 9. Master Abort, No Response
PCI CLOCK
FRAME #
IRDY#
TRDY#
DEVSEL#
1
2
3
4
5
FAST
DEVICE
MEDIUM
DEVICE
SLOW
DEVICE
BRIDGE
DEVICE
(SUBTRACTIVE
DECODE)
67
8
(I) = DRIVEN BY INITIATOR
(T) = DRIVEN BY TARGET
(T)
(I)
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PDF描述 |
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