参数资料
| 型号： | IP-RIOPHY |
| 厂商： | Altera |
| 文件页数： | 114/212页 |
| 文件大小： | 0K |
| 描述： | IP RAPID I/O |
| 标准包装： | 1 |
| 系列： | * |
| 类型： | MegaCore |
| 功能： | 快速输入/输出接口，物理层 |
| 许可证： | 初始许可证 |
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4–64
Chapter 4: Functional Description
Logical Layer Modules
16-bit device ID. Table 4–19 shows the composition of the fields in the RapidIO packet
header and the payload as they correspond to each clock cycle. The gen_tx_empty bits
indicate a value of 0, because all bytes of the last word are read.
Table 4–19. RapidIO Header Fields on the gen_tx_data Bus (Part 1 of 2)
Cycle
Field
gen_tx_data bus
Value
Comment
Value is a don’t care, because it is overwritten by the
ackID
[63:59]
5'h00
Physical layer ackID value before the packet is
transmitted on the RapidIO link.
rsvd
CRF
[58:57]
[56]
2'h0
1'b0
Priority of the RESPONSE packet. Value must be
prio
[55:54]
2'b10
incremented from the priority value of the REQUEST
packet. For example, prio value 2’b10 indicates that the
original request had a priority value of 2’b01.
tt
[53:52]
2'h1
Indicates 16-bit device IDs.
1
2
3
4
ftype
destinationId
sourceId
ttype
status
targetTID
Payload Byte0,1
Payload Byte2,3
Payload Byte4,5
Payload Byte6,7
Payload Byte8,9
Payload
Byte10,11
Payload
Byte12,13
Payload
Byte14,15
Payload
Byte16,17
Payload
Byte18,19
Payload
Byte20,21
Payload
Byte22,23
[51:48]
[47:32]
[31:16]
[15:12]
[11:8]
[7:0]
[63:48]
[47:32]
[31:16]
[15:0]
[63:48]
[47:32]
[31:16]
[15:0]
[63:48]
[47:32]
[31:16]
[15:0]
4'hd
16'hccdc
16'haaba
4'h8
4'h0
8'h00
16'h0102
16'h0304
16'h0506
16'h0708
16'h090a
16'h0b0c
16'h0d0e
16'h0f10
16'h1112
16'h1314
16'h1516
16'h1718
A value of 4'hd (13 decimal) indicates a Response Class
packet.
A value of 8 indicates a RESPONSE transaction with data
payload.
A value of 0 indicates DONE . Requested transaction has
been successfully completed.
Value in the response packet matches the sourceTID of
the corresponding request packet.
Payload double word 0
Payload double word 1
Payload double word 2
RapidIO MegaCore Function
User Guide
May 2013 Altera Corporation
相关PDF资料 |
PDF描述 |
|---|---|
| IP-RLDRAMII | IP RLDRAM II CONTROLLER |
| IP-RSDEC | IP REED-SOLOMON DECODER |
| IP-SDI | IP VIDEO INTERFACE - SDI |
| IP-SDRAM/DDR2 | IP DDR2 SDRAM CONTROLLER |
| IP-SLITE2 | IP SERIALLITE II |
相关代理商/技术参数 |
参数描述 |
|---|---|
| IPRL2 | 制造商:Carlo Gavazzi 功能描述: |
| IPRL3 | 制造商:Carlo Gavazzi 功能描述: 制造商:Carlo Gavazzi 功能描述:IL FL PB PL 22MM GRN |
| IPRL6 | 制造商:Carlo Gavazzi 功能描述:IL FL PB PL 22MM WHT |
| IP-RLDII/UNI | 功能描述:开发软件 RLDRAM II Controllrs MegaCore RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IP-RLDRAMII | 功能描述:开发软件 RLDRAM II Controllrs MegaCore RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
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