参数资料
| 型号： | IP-RIOPHY |
| 厂商： | Altera |
| 文件页数： | 86/212页 |
| 文件大小： | 0K |
| 描述： | IP RAPID I/O |
| 标准包装： | 1 |
| 系列： | * |
| 类型： | MegaCore |
| 功能： | 快速输入/输出接口，物理层 |
| 许可证： | 初始许可证 |
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4–36
Chapter 4: Functional Description
Logical Layer Modules
The port-write processor is controlled through the use of the registers that are
described in the following sections:
■
■
Port-Write Transmission
To send a port-write to a remote device, you must program the transmit port-write
control and data registers. The Tx Port Write Control register is described in
slave interface. The following header fields are supplied by the values stored at the Tx
Port Write Control register:
■
■
■
DESTINATION_ID
priority
wrsize
The other fields of the MAINTENANCE port-write packet are assigned as follows. The
ftype is assigned a value of 4'b1000 and the ttype field is assigned a value of
4'b0100 . The wdptr and wrsize fields of the transmitted packet are calculated from
the size of the payload to be sent as defined by the size field of the Tx Port Write
Control register. The source_tid and config_offset are reserved and set to zero.
The payload is written to a Tx Port Write Buffer starting at address 0x10210 . This
buffer can store a maximum of 64 bytes. The port-write processor starts the packet
composition and transmission process after the PACKET_READY bit in the Tx Port Write
Control register is set. The composed Maintenance port-write packet is sent to the
Transport layer for transmission.
Port-Write Reception
The Maintenance module receives a MAINTENANCE packet on the Rx Atlantic interface
from the Transport layer. The port-write processor handles MAINTENANCE packets with
a ttype value set to 4'b0100 . The port-write processor extracts the following fields
from the packet header and uses them to write the appropriate content to registers Rx
Port Write Control ( Table 6–36 on page 6–19 ) through Rx Port Write Buffer
■
■
■
wrsize
wdptr
payload
The wrsize and the wdptr determine the value of the PAYLOAD_SIZE field in the Rx
Port Write Status register ( Table 6–37 on page 6–20 ). The payload is written to the
Rx Port Write Buffer starting at address 0x10260 . A maximum of 64 bytes can be
written. While the payload is written to the buffer, the PORT_WRITE_BUSY bit of the Rx
Port Write Status register remains asserted. After the payload is completely written
to the buffer, the interrupt signal sys_mnt_s_irq is asserted by the Concentrator on
behalf of the Port Write Processor. The interrupt is asserted only if the
RapidIO MegaCore Function
User Guide
May 2013 Altera Corporation
相关PDF资料 |
PDF描述 |
|---|---|
| IP-RLDRAMII | IP RLDRAM II CONTROLLER |
| IP-RSDEC | IP REED-SOLOMON DECODER |
| IP-SDI | IP VIDEO INTERFACE - SDI |
| IP-SDRAM/DDR2 | IP DDR2 SDRAM CONTROLLER |
| IP-SLITE2 | IP SERIALLITE II |
相关代理商/技术参数 |
参数描述 |
|---|---|
| IPRL2 | 制造商:Carlo Gavazzi 功能描述: |
| IPRL3 | 制造商:Carlo Gavazzi 功能描述: 制造商:Carlo Gavazzi 功能描述:IL FL PB PL 22MM GRN |
| IPRL6 | 制造商:Carlo Gavazzi 功能描述:IL FL PB PL 22MM WHT |
| IP-RLDII/UNI | 功能描述:开发软件 RLDRAM II Controllrs MegaCore RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IP-RLDRAMII | 功能描述:开发软件 RLDRAM II Controllrs MegaCore RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
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