参数资料
| 型号： | IP-RIOPHY |
| 厂商： | Altera |
| 文件页数： | 94/212页 |
| 文件大小： | 0K |
| 描述： | IP RAPID I/O |
| 标准包装： | 1 |
| 系列： | * |
| 类型： | MegaCore |
| 功能： | 快速输入/输出接口，物理层 |
| 许可证： | 初始许可证 |
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4–44
Chapter 4: Functional Description
Logical Layer Modules
Input/Output Avalon-MM Master Module Timing Diagrams
an incoming RapidIO NREAD transaction. Figure 4–21 shows the timing dependencies
on the Avalon-MM master interface for an incoming RapidIO NWRITE transaction.
Both transaction requests are received on the RapidIO link and sent on to the Logical
layer Avalon-MM master module. If the RapidIO link partner is also an Altera
Avalon-MM interface of the RapidIO link partner ’s Input/Output Avalon-MM slave
module.
Figure 4–20. NREAD Transaction on the Input/Output Avalon-MM Master Interface
sysclk
io_m_rd_waitrequest
io_m_rd_read
io_m_rd_address[31:0]
io_m_rd_burstcount[7:0]
00000000
00
Adr0
01
02
Adr1
io_m_rd_readdatavalid
io_m_rd_readerror
io_m_rd_readdata[31:0]
r0
r1
r2
Figure 4–21. NWRITE Transaction on the Input/Output Avalon-MM Master Interface
sysclk
io_m_wr_waitrequest
io_m_wr_write
io_m_wr_address[31:0]
AdrA
AdrB
io_m_wr_writedata[31:0]
w0
w1
w2
w3
w4
w5
io_m_wr_byteenable[3:0]
F
io_m_wr_burstcount[7:0]
RapidIO MegaCore Function
User Guide
02
04
May 2013 Altera Corporation
相关PDF资料 |
PDF描述 |
|---|---|
| IP-RLDRAMII | IP RLDRAM II CONTROLLER |
| IP-RSDEC | IP REED-SOLOMON DECODER |
| IP-SDI | IP VIDEO INTERFACE - SDI |
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| IP-SLITE2 | IP SERIALLITE II |
相关代理商/技术参数 |
参数描述 |
|---|---|
| IPRL2 | 制造商:Carlo Gavazzi 功能描述: |
| IPRL3 | 制造商:Carlo Gavazzi 功能描述: 制造商:Carlo Gavazzi 功能描述:IL FL PB PL 22MM GRN |
| IPRL6 | 制造商:Carlo Gavazzi 功能描述:IL FL PB PL 22MM WHT |
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| IP-RLDRAMII | 功能描述:开发软件 RLDRAM II Controllrs MegaCore RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
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