参数资料
型号: IP-RIOPHY
厂商: Altera
文件页数: 159/212页
文件大小: 0K
描述: IP RAPID I/O
标准包装: 1
系列: *
类型: MegaCore
功能: 快速输入/输出接口,物理层
许可证: 初始许可证
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Chapter 6: Software Interface
Transport and Logical Layer Registers
Refer to “Port-Write Processor” on page 4–35 for information about using these
registers to transmit a port-write.
Table 6–33. Tx Port Write Control—Offset: 0x10200
6–19
Field
Bits
Access
Function
Default
RO
Reserved if the system does not support 16-bit device ID.
LARGE_DESTINATION_ID
(MSB)
DESTINATION_ID
RSRV
[31:24]
[23:16]
[15:8]
RW
RW
RO
MSB of the Destination ID if the system supports 16-bit
device ID.
Destination ID
Reserved
8'h0
8'h0
8'h00
Request packet’s priority.
PRIORITY
[7:6]
RW
2’b11 is not a valid value for the priority field. An attempt
2'b00
to write 2’b11 to this field is overwritten as 2’b10.
Packet payload size in number of double words. If set to 0,
SIZE
[5:2]
RW
the payload size is single word. If size is set to a value
4'h0
larger than 8, the payload size is 8 double words (64 bytes).
RSRV
[1]
RO
Reserved
1'b0
Write 1 to start transmitting the port-write request. This bit
PACKET_READY
[0]
RW
is cleared internally after the packet has been transferred to
the Transport layer to be forwarded to the Physical layer for
1'b0
transmission.
Table 6–34. Tx Port Write Status—Offset: 0x10204
Field
Bits
Access
Function
Default
RSRV
[31:0] RO
Reserved
31'h0
Table 6–35. Tx Port Write Buffer n—Offset: 0x10210 – 0x1024C
Field
Bits
Access
Function
Default
PORT_WRITE_DATA_n
[31:0] RW
Port-write data. This buffer is implemented in memory and is
not initialized at reset.
32'hx
Receive Port-Write Registers
Table 6–36 through Table 6–38 describe the receive port-write registers.
Refer to “Port-Write Reception Module” on page 4–69 for information about receiving
port write MAINTENANCE packets.
Table 6–36. Rx Port Write Control—Offset: 0x10250
Field
Bits
Access
Function
Default
RSRV
[31:2] RO
Reserved
30'h0
CLEAR_BUFFER
PORT_WRITE_ENA
[1]
[0]
RW
RW
Clear port-write buffer. Write 1 to activate. Always read 0.
Port-write enable. If set to 1, port-write packets are accepted.
If set to 0, port-write packets are dropped.
1'b0
1'b1
May 2013
Altera Corporation
RapidIO MegaCore Function
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