参数资料
| 型号： | IP-RIOPHY |
| 厂商： | Altera |
| 文件页数： | 164/212页 |
| 文件大小： | 0K |
| 描述： | IP RAPID I/O |
| 标准包装： | 1 |
| 系列： | * |
| 类型： | MegaCore |
| 功能： | 快速输入/输出接口，物理层 |
| 许可证： | 初始许可证 |
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6–24
Chapter 6: Software Interface
Transport and Logical Layer Registers
Table 6–50. Input/Output Slave RapidIO Write Requests—Offset: 0x10510
RSRV
Field
Bits
[31:16]
Access
RO
Reserved
Function
Default
16'h0
Number of write-request packets transferred
from the Avalon-MM Input/Output Slave
module to the Transport layer or cancelled.
COMPLETED_OR_CANCELLED_WRITES
[15:0]
RO
Count increments when the write-request
16'b0
packet is sent to the Transport layer, or when
a write transaction is cancelled. This counter
rolls over to 0 after its maximum value.
Transport Layer Feature Register
Transport layer mode.
Table 6–51. Rx Transport Control—Offset: 0x10600
RSRV
Field
Bits
[31:1]
Access
RO
Reserved
Function
Default
31'h0
This bit determines whether the Transport layer checks
destination IDs in incoming request packets, or
PROMISCUOUS_MODE
[0]
RW
promiscuously accepts all incoming request packets
with a supported ftype . The reset value is set in the
RapidIO parameter editor.
(1) The default value is set in the RapidIO parameter editor.
Error Management Registers
registers can be used by software to diagnose problems with packets that are received
by the local endpoint. If enabled, the detected error triggers the assertion of
sys_mnt_s_irq . Information about the packet that caused the error is captured in the
capture registers. After an error condition is detected, the information is captured and
the capture registers are locked until the Error Detect CSR is cleared. Upon being
cleared, the capture registers are ready to capture a new packet that exhibits an error
condition.
Table 6–52. Logical/Transport Layer Error Detect CSR—Offset: 0x10800 (Part 1 of 2)
Field
IO_ERROR_RSP
Bits
[31]
Access
RW
Function
Received a response of ERROR for an I/O Logical Layer Request.
Default
1'b0
MSG_ERROR_RESPONSE
[30]
RW
Received a response of ERROR for a MSG Logical Layer Request. 1'b0
GSM error response
MSG_FORMAT_ERROR
ILL_TRAN_DECODE
[29]
[28]
[27]
RO
RW
RW
This feature is not supported.
Received MESSAGE packet data payload with an invalid size or
segment.
Received illegal fields in the request/response packet for a
supported transaction.
1'b0
1'b0
1'b0
RapidIO MegaCore Function
User Guide
May 2013 Altera Corporation
相关PDF资料 |
PDF描述 |
|---|---|
| IP-RLDRAMII | IP RLDRAM II CONTROLLER |
| IP-RSDEC | IP REED-SOLOMON DECODER |
| IP-SDI | IP VIDEO INTERFACE - SDI |
| IP-SDRAM/DDR2 | IP DDR2 SDRAM CONTROLLER |
| IP-SLITE2 | IP SERIALLITE II |
相关代理商/技术参数 |
参数描述 |
|---|---|
| IPRL2 | 制造商:Carlo Gavazzi 功能描述: |
| IPRL3 | 制造商:Carlo Gavazzi 功能描述: 制造商:Carlo Gavazzi 功能描述:IL FL PB PL 22MM GRN |
| IPRL6 | 制造商:Carlo Gavazzi 功能描述:IL FL PB PL 22MM WHT |
| IP-RLDII/UNI | 功能描述:开发软件 RLDRAM II Controllrs MegaCore RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IP-RLDRAMII | 功能描述:开发软件 RLDRAM II Controllrs MegaCore RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
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