参数资料
| 型号： | IP-RIOPHY |
| 厂商： | Altera |
| 文件页数： | 83/212页 |
| 文件大小： | 0K |
| 描述： | IP RAPID I/O |
| 标准包装： | 1 |
| 系列： | * |
| 类型： | MegaCore |
| 功能： | 快速输入/输出接口，物理层 |
| 许可证： | 初始许可证 |
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Chapter 4: Functional Description
Logical Layer Modules
4–33
■
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■
■
ttype is assigned a value of 4'b0000 for reads and a value of 4'b0001 for writes
rdsize/wrsize field is fixed at 4'b1000 , because only 4-byte reads and writes are
supported
source_tid
hop_count
config_offset is generated by using the values programmed in the Tx
wdptr
Each window is enabled if the window enable ( WEN ) bit of the Tx Maintenance Window
n Mask register ( Table 6–30 on page 6–18 ) is set. Each window is defined by the
following registers:
■
■
■
■
For each defined and enabled window, the Avalon-MM address's least significant bits
are masked out by the window mask and the resulting address is compared to the
window base. If the addresses match, config_offset is created based on the
following equation:
If (mnt_s_address & mask) == base
then config_offset = (offset[23:3] & mask[23:3])|
(mnt_s_address[23:3] & ~mask[23:3])
where:
■
■
■
■
■
mnt_s_address[31:0] is the Avalon-MM slave interface address
config_offset[20:0] is the outgoing RapidIO register double-word offset
base[31:0] is the base address register
mask[31:0] is the mask register
offset[23:0] is the window offset register
If the address matches multiple windows, the lowest number window register set is
used.
The following fields are inserted from the control register of the mapping window
that matches.
■
■
■
prio
dest_id
hop_count
The tt value is determined by your selection of device ID width at the time you create
this RapidIO IP core variation. The source_tid is generated internally and the wdptr
is assigned the negation of mnt_s_address[2] .
May 2013
Altera Corporation
RapidIO MegaCore Function
User Guide
相关PDF资料 |
PDF描述 |
|---|---|
| IP-RLDRAMII | IP RLDRAM II CONTROLLER |
| IP-RSDEC | IP REED-SOLOMON DECODER |
| IP-SDI | IP VIDEO INTERFACE - SDI |
| IP-SDRAM/DDR2 | IP DDR2 SDRAM CONTROLLER |
| IP-SLITE2 | IP SERIALLITE II |
相关代理商/技术参数 |
参数描述 |
|---|---|
| IPRL2 | 制造商:Carlo Gavazzi 功能描述: |
| IPRL3 | 制造商:Carlo Gavazzi 功能描述: 制造商:Carlo Gavazzi 功能描述:IL FL PB PL 22MM GRN |
| IPRL6 | 制造商:Carlo Gavazzi 功能描述:IL FL PB PL 22MM WHT |
| IP-RLDII/UNI | 功能描述:开发软件 RLDRAM II Controllrs MegaCore RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IP-RLDRAMII | 功能描述:开发软件 RLDRAM II Controllrs MegaCore RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
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