参数资料
| 型号： | IP-RIOPHY |
| 厂商： | Altera |
| 文件页数： | 152/212页 |
| 文件大小： | 0K |
| 描述： | IP RAPID I/O |
| 标准包装： | 1 |
| 系列： | * |
| 类型： | MegaCore |
| 功能： | 快速输入/输出接口，物理层 |
| 许可证： | 初始许可证 |
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6–12
Chapter 6: Software Interface
Transport and Logical Layer Registers
Table 6–13. Device Information CAR—Offset: 0x04
Field
DEVICE_REV
Bits
[31:0]
Access
RO
Function
Hard-wired device revision level
Default
(1) The default value is set in the RapidIO parameter editor.
Table 6–14. Assembly Identity CAR—Offset: 0x08
Field
ASSY_ID
ASSY_VENDOR_ID
Bits
[31:16]
[15:0]
Access
RO
RO
Function
Hard-wired assembly identifier
Hard-wired assembly vendor identifier
Default
(1) The default value is set in the RapidIO parameter editor.
Table 6–15. Assembly Information CAR—Offset: 0x0C
Field
Bits
Access
Function
Default
ASSY_REV
[31:16] RO
Hard-wired assembly revision level
EXT_FEATURE_PTR
[15:0]
RO
Hard-wired pointer to the first entry in the extended feature list.
This pointer must be in the range of 16'h100 and 16'hFFFC.
(1) The default value is set in the RapidIO parameter editor.
Table 6–16. Processing Element Features CAR—Offset: 0x10 (Part 1 of 2)
BRIDGE
Field
Bits
[31]
Access
RO
Function
Processing element can bridge to another interface.
Default
Processing element has physically addressable local address
space and can be accessed as an endpoint through
MEMORY
[30]
RO
nonmaintenance operations. This local address space may be
limited to local configuration registers, on-chip SRAM, or other
device.
Processing element physically contains a local processor or
PROCESSOR
[29]
RO
similar device that executes code. A device that bridges to an
interface that connects to a processor does not count.
Processing element can bridge to another external RapidIO
SWITCH
[28]
RO
interface—an internal port to a local endpoint does not count as
a switch port.
RSRV
[27:7]
RO
Reserved
21'h0
Processing element supports suppression of error recovery on
packet CRC errors:
RE_TRAN_SUP
[6]
RO
1'b0—The error recovery suppression option is not
1'b0
supported
1'b1—The error recovery suppression option is supported
RapidIO MegaCore Function
User Guide
May 2013 Altera Corporation
相关PDF资料 |
PDF描述 |
|---|---|
| IP-RLDRAMII | IP RLDRAM II CONTROLLER |
| IP-RSDEC | IP REED-SOLOMON DECODER |
| IP-SDI | IP VIDEO INTERFACE - SDI |
| IP-SDRAM/DDR2 | IP DDR2 SDRAM CONTROLLER |
| IP-SLITE2 | IP SERIALLITE II |
相关代理商/技术参数 |
参数描述 |
|---|---|
| IPRL2 | 制造商:Carlo Gavazzi 功能描述: |
| IPRL3 | 制造商:Carlo Gavazzi 功能描述: 制造商:Carlo Gavazzi 功能描述:IL FL PB PL 22MM GRN |
| IPRL6 | 制造商:Carlo Gavazzi 功能描述:IL FL PB PL 22MM WHT |
| IP-RLDII/UNI | 功能描述:开发软件 RLDRAM II Controllrs MegaCore RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IP-RLDRAMII | 功能描述:开发软件 RLDRAM II Controllrs MegaCore RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
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