参数资料
| 型号： | IP-RIOPHY |
| 厂商： | Altera |
| 文件页数： | 169/212页 |
| 文件大小： | 0K |
| 描述： | IP RAPID I/O |
| 标准包装： | 1 |
| 系列： | * |
| 类型： | MegaCore |
| 功能： | 快速输入/输出接口，物理层 |
| 许可证： | 初始许可证 |
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Chapter 6: Software Interface
Transport and Logical Layer Registers
Table 6–64. Tx Doorbell Completion Status—Offset: 0x18
6–29
Field
Bits
Access
Function
Default
RSRV
[31:2] RO
Reserved
30'h0
This error code corresponds to the most recently read message from
the Tx Doorbell Completion register. After software reads the Tx
Doorbell Completion register, a read to this register should follow
ERROR_CODE
[1:0]
RO
to determine the status of the message.
2'h0
2'b00—Response DONE status
2'b01—Response with ERROR status
2'b10—Time-out error
Table 6–65. Tx Doorbell Status Control—Offset: 0x1C
RSRV
Field
Bits
[31:2]
Access
RO
Reserved
Function
Default
30'h0
If set, outbound DOORBELL messages that received a response with
ERROR
[1]
RW
ERROR status, or were timed out, are stored in the Tx Completion
1'h0
FIFO. Otherwise, no error reporting occurs.
If set, responses to successful outbound DOORBELL messages are
COMPLETED
[0]
RW
stored in the Tx Completion FIFO. Otherwise, these responses are
discarded.18
1'h0
Table 6–66. Doorbell Interrupt Enable—Offset: 0x20
Field
RSRV
TX_CPL_OVERFLOW
TX_CPL
RX
Bits
[31:3]
[2]
[1]
[0]
Access
RO
RW
RW
RW
Function
Reserved
Tx Doorbell Completion Buffer Overflow Interrupt Enable
Tx Doorbell Completion Interrupt Enable
Doorbell Received Interrupt Enable
Default
29'b0
1'h0
1'h0
1'h0
Table 6–67. Doorbell Interrupt Status—Offset: 0x24
RSRV
Field
Bits
[31:3]
Access
RO
Reserved
Function
Default
29'h0
Interrupt asserted due to Tx Completion buffer overflow. This bit
remains set until at least one entry is read from the Tx
TX_CPL_OVERFLOW
[2]
RW1C
Completion FIFO. After reading at least one entry, software
1'h0
should clear this bit. It is not necessary to read all of the Tx
Completion FIFO entries.
TX_CPL
RX
May 2013
Altera Corporation
[1]
[0]
RW1C
RW1C
Interrupt asserted due to Tx completion status
Interrupt asserted due to received messages
1'h0
1'h0
RapidIO MegaCore Function
User Guide
相关PDF资料 |
PDF描述 |
|---|---|
| IP-RLDRAMII | IP RLDRAM II CONTROLLER |
| IP-RSDEC | IP REED-SOLOMON DECODER |
| IP-SDI | IP VIDEO INTERFACE - SDI |
| IP-SDRAM/DDR2 | IP DDR2 SDRAM CONTROLLER |
| IP-SLITE2 | IP SERIALLITE II |
相关代理商/技术参数 |
参数描述 |
|---|---|
| IPRL2 | 制造商:Carlo Gavazzi 功能描述: |
| IPRL3 | 制造商:Carlo Gavazzi 功能描述: 制造商:Carlo Gavazzi 功能描述:IL FL PB PL 22MM GRN |
| IPRL6 | 制造商:Carlo Gavazzi 功能描述:IL FL PB PL 22MM WHT |
| IP-RLDII/UNI | 功能描述:开发软件 RLDRAM II Controllrs MegaCore RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IP-RLDRAMII | 功能描述:开发软件 RLDRAM II Controllrs MegaCore RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
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