参数资料
| 型号： | IP-RIOPHY |
| 厂商： | Altera |
| 文件页数： | 33/212页 |
| 文件大小： | 0K |
| 描述： | IP RAPID I/O |
| 标准包装： | 1 |
| 系列： | * |
| 类型： | MegaCore |
| 功能： | 快速输入/输出接口，物理层 |
| 许可证： | 初始许可证 |
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Chapter 2: Getting Started
2–11
Instantiating Multiple RapidIO IP Cores
Controllers and four RapidIO IP cores. In the example, Altera Transceiver
Reconfiguration Controller 0 has seven reconfiguration interfaces, and Altera
Transceiver Reconfiguration Controller 1 has four reconfiguration interfaces. Each
sub-block shown in a Transceiver Reconfiguration Controller block represents a single
reconfiguration interface. The example shows only one possible configuration for this
combination of RapidIO IP cores; subject to the constraints described, you may choose
a different configuration.
Figure 2–3. Example Connections Between Two Transceiver Reconfiguration Controllers and Four RapidIO IP Cores
reconfig_from_xcvr[N-1:0]
reconfig_to_xcvr[M-1:0]
reconfig_fromgxb[N-1:0]
reconfig_togxb[M-1:0]
reconfig_from_xcvr[N-1:0]
reconfig_to_xcvr[M-1:0]
reconfig_fromgxb[2N-1:N]
reconfig_togxb[2M-1:M]
4x RapidIO
reconfig_from_xcvr[N-1:0]
reconfig_to_xcvr[M-1:0]
reconfig_fromgxb[3N-1:2N] IP Core
reconfig_togxb[3M-1:2M]
Altera
Transceiver
Reconfiguration
Controller
0
reconfig_from_xcvr[N-1:0]
reconfig_to_xcvr[M-1:0]
reconfig_from_xcvr[N-1:0]
reconfig_to_xcvr[M-1:0]
reconfig_from_xcvr[N-1:0]
reconfig_fromgxb[4N-1:3N]
reconfig_togxb[4M-1:3M]
reconfig_fromgxb[5N-1:4N]
reconfig_togxb[5M-1:4M]
reconfig_fromgxb[N-1:0]
reconfig_fromgxb[N-1:0]
reconfig_from_xcvr[N-1:0]
reconfig_to_xcvr[M-1:0]
reconfig_from_xcvr[N-1:0]
reconfig_to_xcvr[M-1:0]
reconfig_togxb[M-1:0]
reconfig_fromgxb[2N-1:N]
reconfig_togxb[2M-1:M]
1x RapidIO
IP Core
1x RapidIO
reconfig_togxb[M-1:0]
reconfig_to_xcvr[M-1:0]
IP Core
reconfig_fromgxb[2N-1:N]
reconfig_togxb[2M-1:M]
reconfig_from_xcvr[N-1:0]
reconfig_to_xcvr[M-1:0]
Altera
Transceiver
reconfig_fromgxb[N-1:0]
1x RapidIO reconfig_togxb[M-1:0]
IP Core reconfig_fromgxb[2N-1:N]
reconfig_togxb[2M-1:M]
reconfig_from_xcvr[N-1:0]
reconfig_to_xcvr[M-1:0]
reconfig_from_xcvr[N-1:0]
reconfig_to_xcvr[M-1:0]
Reconfiguration
Controller
1
f Refer to the "Transceiver Reconfiguration Controller" chapter of the Altera Transceiver
Controller interfaces and how to control dynamic reconfiguration for multiple
transceiver channels. Refer to Table 5–12 on page 5–7 for information about the
reconfig_fromgxb and reconfig_togxb signals that connect a single RapidIO IP core
to multiple Transceiver Reconfiguration Controller interfaces of the same Transceiver
Reconfiguration Controller.
To enable the Quartus II software to place distinct RapidIO IP cores in the same
Arria V, Cyclone V, or Stratix V transceiver block, you must ensure that the
phy_mgmt_clk input to each RapidIO IP core is driven by the same programming
interface clock.
May 2013
Altera Corporation
RapidIO MegaCore Function
User Guide
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PDF描述 |
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