参数资料
| 型号： | IP-RIOPHY |
| 厂商： | Altera |
| 文件页数： | 39/212页 |
| 文件大小： | 0K |
| 描述： | IP RAPID I/O |
| 标准包装： | 1 |
| 系列： | * |
| 类型： | MegaCore |
| 功能： | 快速输入/输出接口，物理层 |
| 许可证： | 初始许可证 |
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Chapter 3: Parameter Settings
3–3
Physical Layer Settings
Transceiver Configuration
In the MegaWizard Plug-In Manager flow, for the Arria GX, Arria II GX, Arria II GZ,
Cyclone IV GX, HardCopy IV GX, Stratix II GX, and Stratix IV GX transceiver
options, you can click Configure Transceiver to set the analog parameters for the
transceiver block. When you click Configure Transceiver , the transceiver parameter
editor appears. The transceiver parameter editor offers several configuration
parameters that you can set, based on board-level conditions, design constraints, or
other application-specific requirements, to ensure the proper operation of the serial
link. Other transceiver parameters are preset to values compatible with the RapidIO
IP core and the selected mode and device family, and cannot be modified. The default
values in this interface specify a transceiver configuration that is compatible with the
RapidIO IP core.
The Arria V GX PHY , Arria V GZ PHY , Cyclone V GX PHY , and Stratix V GX PHY
selections do not support a Configure Transceiver option, because the transceiver
parameters are all set to required values automatically. The RapidIO IP core
instantiates a Custom PHY IP core to configure the Arria V, Cyclone V, or Stratix V
transceivers.
The Qsys flow does not support a Configure Transceiver option. To modify the
default transceiver configuration in a RapidIO IP core you generate in the Qsys flow,
you must edit the ALTGX megafunction instance in the MegaWizard Plug-In
Manager. If your RapidIO IP core targets an Arria V, Cyclone V, or Stratix V device,
Altera recommends you do not modify the default transceiver settings configured in
the Custom PHY IP core instance generated with the RapidIO IP core.
1
When you regenerate your RapidIO IP core, the ALTGX megafunction instance
reverts to the default settings determined by the RapidIO component. To modify the
default transceiver configuration, you must re-edit the ALTGX megafunction
manually following every regeneration of the RapidIO IP core.
f For details of the transceiver block and the transceiver parameter editor, refer to the
documents listed in the following table:
,
For information about
Arria GX transceiver
megafunction
Arria II GX or Arria II GZ
Refer to
Arria GX Transceiver User Guide section in volume 2 of the Arria GX
Device Handbook
transceiver megafunction Arria II Device Handbook
Arria V transceivers
Cyclone IV GX
transceiver megafunction Cyclone IV Device Handbook
Cyclone V transceivers
HardCopy IV transceiver
megafunction
Stratix II GX transceiver
megafunction
Stratix IV transceiver
megafunction
Stratix II GX Transceiver User Guide section in volume 2 of the
Stratix II GX Device Handbook
Transceiver Configuration Guide section in Volume 3 of the Stratix IV
Device Handbook
May 2013
Altera Corporation
RapidIO MegaCore Function
User Guide
相关PDF资料 |
PDF描述 |
|---|---|
| IP-RLDRAMII | IP RLDRAM II CONTROLLER |
| IP-RSDEC | IP REED-SOLOMON DECODER |
| IP-SDI | IP VIDEO INTERFACE - SDI |
| IP-SDRAM/DDR2 | IP DDR2 SDRAM CONTROLLER |
| IP-SLITE2 | IP SERIALLITE II |
相关代理商/技术参数 |
参数描述 |
|---|---|
| IPRL2 | 制造商:Carlo Gavazzi 功能描述: |
| IPRL3 | 制造商:Carlo Gavazzi 功能描述: 制造商:Carlo Gavazzi 功能描述:IL FL PB PL 22MM GRN |
| IPRL6 | 制造商:Carlo Gavazzi 功能描述:IL FL PB PL 22MM WHT |
| IP-RLDII/UNI | 功能描述:开发软件 RLDRAM II Controllrs MegaCore RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IP-RLDRAMII | 功能描述:开发软件 RLDRAM II Controllrs MegaCore RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
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