参数资料
| 型号： | IP-RIOPHY |
| 厂商： | Altera |
| 文件页数： | 30/212页 |
| 文件大小： | 0K |
| 描述： | IP RAPID I/O |
| 标准包装： | 1 |
| 系列： | * |
| 类型： | MegaCore |
| 功能： | 快速输入/输出接口，物理层 |
| 许可证： | 初始许可证 |
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2–8
Chapter 2: Getting Started
Specifying Constraints
Specifying Constraints
Altera provides constraint files in Tcl format that you must apply to ensure that the
RapidIO IP core meets design timing requirements.
1
Constraints are not set automatically. You must run the Tcl constraint script to apply
the constraints, in all three design flows.
To use the generated constraint files, follow these steps:
1. Open your Quartus II project in the Quartus II software.
2. On the View menu, point to Utility Windows and then click Tcl Console .
3. Source the generated constraint file by following one of these two steps:
■
■
In the MegaWizard Plug-In Manager flow, type the following command at the
Tcl console command prompt:
source <variation_name> _constraints.tcl r
In the Qsys flow, type the following command at the Tcl console command
prompt:
source
< Qsys_system_name >/synthesis/submodules/< Qsys_system_name >_< instance_name >_constraints.tcl r
4. Add the Rapid IO constraints to your project by typing the following command at
the Tcl console command prompt:
add_rio_constraints r
This command adds the necessary logic constraints to your Quartus II project.
In the Qsys flow, you are likely to require the -ref_clk_name , -sys_clk_name ,
The script automatically constrains the system clocks and the reference clock based on
the data rate chosen. For supported transceivers, Altera recommends that you adjust
the reference clock frequency in the Physical Layer tab of the RapidIO parameter
editor only. However, you can adjust the system clock frequency in the Tcl constraints
script or the generated Synopsys Design Constraint File ( .sdc ).
The Tcl script assumes that virtual pins and I/O standards are connected to
Altera-provided pin names. For user-defined pin names, you must edit the script after
generation to ensure that the assignments are made properly.
The add_rio_constraints command has the following additional options that you
can use:
add_rio_constraints [-no_compile]
[-ref_clk_name < name >] [-sys_clk_name < name >] [-phy_mgmt_clk_name < name >]
[-patch_sdc] [-help]
RapidIO MegaCore Function
User Guide
May 2013 Altera Corporation
相关PDF资料 |
PDF描述 |
|---|---|
| IP-RLDRAMII | IP RLDRAM II CONTROLLER |
| IP-RSDEC | IP REED-SOLOMON DECODER |
| IP-SDI | IP VIDEO INTERFACE - SDI |
| IP-SDRAM/DDR2 | IP DDR2 SDRAM CONTROLLER |
| IP-SLITE2 | IP SERIALLITE II |
相关代理商/技术参数 |
参数描述 |
|---|---|
| IPRL2 | 制造商:Carlo Gavazzi 功能描述: |
| IPRL3 | 制造商:Carlo Gavazzi 功能描述: 制造商:Carlo Gavazzi 功能描述:IL FL PB PL 22MM GRN |
| IPRL6 | 制造商:Carlo Gavazzi 功能描述:IL FL PB PL 22MM WHT |
| IP-RLDII/UNI | 功能描述:开发软件 RLDRAM II Controllrs MegaCore RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IP-RLDRAMII | 功能描述:开发软件 RLDRAM II Controllrs MegaCore RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
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