- 您现在的位置：买卖IC网 > PDF目录69324 > S1C17554B00E10H 16-BIT, FLASH, 24 MHz, RISC MICROCONTROLLER, PBGA48 PDF资料下载
参数资料
| 型号： | S1C17554B00E10H |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 16-BIT, FLASH, 24 MHz, RISC MICROCONTROLLER, PBGA48 |
| 封装： | 3.137 X 3.137 MM, 0.72 MM HEIGHT, 0.40 MM PITCH, WCSP-48 |
| 文件页数： | 166/318页 |
| 文件大小： | 2643K |
| 代理商： | S1C17554B00E10H |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页当前第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页第185页第186页第187页第188页第189页第190页第191页第192页第193页第194页第195页第196页第197页第198页第199页第200页第201页第202页第203页第204页第205页第206页第207页第208页第209页第210页第211页第212页第213页第214页第215页第216页第217页第218页第219页第220页第221页第222页第223页第224页第225页第226页第227页第228页第229页第230页第231页第232页第233页第234页第235页第236页第237页第238页第239页第240页第241页第242页第243页第244页第245页第246页第247页第248页第249页第250页第251页第252页第253页第254页第255页第256页第257页第258页第259页第260页第261页第262页第263页第264页第265页第266页第267页第268页第269页第270页第271页第272页第273页第274页第275页第276页第277页第278页第279页第280页第281页第282页第283页第284页第285页第286页第287页第288页第289页第290页第291页第292页第293页第294页第295页第296页第297页第298页第299页第300页第301页第302页第303页第304页第305页第306页第307页第308页第309页第310页第311页第312页第313页第314页第315页第316页第317页第318页
22 ON-CHIP DEBUGGER (DBG)
22-2
Seiko Epson Corporation
S1C17554/564 TECHNICAL MANUAL
Additional Debugging Function
22.3
The S1C17554/564 expands the following on-chip debugging functions of the S1C17 Core.
Branching destination in debug mode
When a debug interrupt is generated, the S1C17 Core enters debug mode and branches to the debug processing
routine. In this process, the S1C17 Core is designed to branch to address 0xfffc00. In addition to this branching
destination, the S1C17554/564 also allows designation of address 0x0 (beginning address of the internal RAM)
as the branching destination when debug mode is activated. The branching destination address is selected using
DBADR/MISC_IRAMSZ register. When the DBADR is set to 0 (default), the branching destination is set to
0xfffc00. When it is set to 1, the branching destination is set to 0x0.
Adding instruction breaks
The S1C17 Core supports two instruction breaks (hardware PC breaks). The S1C17554/564 increased this
number to five, adding the control bits and registers given below.
IBE2/DCR register:
Enables instruction breaks #2.
IBE3/DCR register:
Enables instruction breaks #3.
IBE4/DCR register:
Enables instruction breaks #4.
IBAR2[23:0]/IBAR2 register: Set instruction break address #2.
IBAR3[23:0]/IBAR3 register: Set instruction break address #3.
IBAR4[23:0]/IBAR4 register: Set instruction break address #4.
Note that the debugger included in the S5U1C17001C (Ver. 1.2.1) or later is required to use five hardware PC
breaks.
Control Register Details
22.4
4.1 List of Debug Registers
Table 22.
Address
Register name
Function
0x4020
MISC_DMODE1 Debug Mode Control Register 1
Enables peripheral operations in debug mode (PCLK).
0x5322
MISC_DMODE2 Debug Mode Control Register 2
Enables peripheral operations in debug mode (except PCLK).
0x5326
MISC_IRAMSZ IRAM Size Select Register
Selects the IRAM size.
0xffff90
DBRAM
Debug RAM Base Register
Indicates the debug RAM base address.
0xffffa0
DCR
Debug Control Register
Controls debugging.
0xffffb8
IBAR2
Instruction Break Address Register 2
Sets Instruction break address #2.
0xffffbc
IBAR3
Instruction Break Address Register 3
Sets Instruction break address #3.
0xffffd0
IBAR4
Instruction Break Address Register 4
Sets Instruction break address #4.
The debug registers are described in detail below.
Notes: When data is written to the registers, the “Reserved” bits must always be written as 0 and not 1.
For debug registers not described here, refer to the S1C17 Core Manual.
Debug Mode Control Register 1 (MISC_DMODE1)
Register name Address
Bit
Name
Function
Setting
Init. R/W
Remarks
Debug Mode
Control
Register 1
(MISC_DMODE1)
0x4020
(8 bits)
D7–2 –
reserved
–
0 when being read.
D1
DBRUN1
Run/stop select in debug mode
1 Run
0 Stop
0
R/W
D0
–
reserved
–
0 when being read.
D[7:2]
Reserved
D1
DBRUN1: Run/Stop Select Bit in Debug Mode
Selects the operating status of the peripheral circuits that operate with PCLK in debug mode.
1 (R/W): Run
0 (R/W): Stop (default)
相关PDF资料 |
PDF描述 |
|---|---|
| S1C17554B00E10M | 16-BIT, FLASH, 24 MHz, RISC MICROCONTROLLER, PBGA48 |
| S1C17554B00E10P | 16-BIT, FLASH, 24 MHz, RISC MICROCONTROLLER, PBGA48 |
| S1C17554B00E10R | 16-BIT, FLASH, 24 MHz, RISC MICROCONTROLLER, PBGA48 |
| S1C17554D00E10E | 16-BIT, FLASH, 24 MHz, RISC MICROCONTROLLER, UUC |
| S1C17554D00E10F | 16-BIT, FLASH, 24 MHz, RISC MICROCONTROLLER, UUC |
相关代理商/技术参数 |
参数描述 |
|---|---|
| S1C17555 | 制造商:EPSON 制造商全称:EPSON 功能描述:16-bit Single Chip Microcontroller |
| S1C17564 | 制造商:EPSON 制造商全称:EPSON 功能描述:16-bit Single Chip Microcontroller |
| S1C17564D111000 | 制造商:Epson Electronics America Inc 功能描述:16-bit, 128KB Flash (OSC3 = Ceramic) |
| S1C17564F111100 | 功能描述:显示驱动器和控制器 16-bit, 128KB Flash RoHS:否 制造商:Panasonic Electronic Components 工作电源电压:2.7 V to 5.5 V 最大工作温度: 安装风格:SMD/SMT 封装 / 箱体:QFN-44 封装:Reel |
| S1C17565 | 制造商:EPSON 制造商全称:EPSON 功能描述:16-bit Single Chip Microcontroller |
发布紧急采购，3分钟左右您将得到回复。