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参数资料
| 型号： | IPR-POSPHY4 |
| 厂商： | Altera |
| 文件页数： | 104/144页 |
| 文件大小： | 0K |
| 描述： | IP POS-PHY L4 RENEW |
| 标准包装： | 1 |
| 系列： | * |
| 类型： | MegaCore |
| 功能： | POS-PHY 4 级接口，链路层/物理层 |
| 许可证： | 续用许可证 |
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6–4
1
Chapter 6: Testbench
Receiver Testbench Examples
To simulate errors using these tasks, you must turn on dynamic phase alignment
(DPA) and Atlantic error checking when parameterizing your MegaCore function.
Table 6–3. Error Generation Tasks in the Packet Generation Module
Task Format
General Description
Input Parameters Description
port[7:0] sets the port address (ADR bits [11:4] of SOP
control word).
err sets the error code for inserting various protocol
errors into the SPI-4 stream. The error codes are:
0 = no error
■
1 = invert DIP4 and set error bit
■
2 = omit start of packet (SOP)
■
3 = omit end of packet (EOP)
■
4 = insert a payload control word mid-packet (not really
■
an error)
Sends a single packet
■
5 = insert an idle followed by a payload control word
spi_gen.pkt2
and can optionally
mid-packet (not really an error)
(port,err,size,pkt_num)
insert various
protocol errors.
■
■
6 = set SOP in idle EOP (odd or even) control word
following packet
7 = set SOP in idle EOP (abort) control word following
packet
■
■
8 = set EOP (abort) for packet and insert error bit in
header
9 = invert dip4 but do not set error bit
All other values are undefined.
size sets the length field of the packet header.
pkt_num[7:0] sets the value of the first byte after the
header. This byte is then incremented for the rest of the
packet.
Sends a control word
for one clock cycle.
spi_gen.cw
(word[15:0],dip4err)
POS-PHY Level 4 MegaCore Function User Guide
The DIP4 is auto
calculated and
inserted into word
[3:0]. The DIP4
calculation can be
inverted.
word[15:0] is the control word to be inserted.
When the dip4err bit is set, the DIP4 calculation is
inverted.
May 2013 Altera Corporation
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PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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| IPR-RLDRAMII | 功能描述:开发软件 RLDRAM II Controller MegaCore RENEWAL RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
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