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参数资料
| 型号： | IPR-POSPHY4 |
| 厂商： | Altera |
| 文件页数： | 20/144页 |
| 文件大小： | 0K |
| 描述： | IP POS-PHY L4 RENEW |
| 标准包装： | 1 |
| 系列： | * |
| 类型： | MegaCore |
| 功能： | POS-PHY 4 级接口，链路层/物理层 |
| 许可证： | 续用许可证 |
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2–4
Chapter 2: Getting Started
Simulate the Design
Altera provides models you can use for functional verification of the POS-PHY Level
4 MegaCore function within your design. A Verilog HDL testbench, including scripts
to run it, is also provided. This testbench, for use with the ModelSim-Altera simulator
or other simulator tools via NativeLink, demonstrates how to instantiate a model in a
design.
This section tells you how to use the testbench with the ModelSim simulator or with
other simulators via NativeLink.
f For a list of the simulators that you can use with NativeLink, refer to the Simulating
c The testbench is in Verilog HDL, so you require a license to run mixed language
simulations to run the testbench with the VHDL model. If you edit any of your
variation’s clear-text Verilog HDL files, you must update the IP functional simulation
model before running the simulator. To update the model, run the quartus_sh -t
<variation_name> _refresh_model.tcl script in the Quartus II software.
Use the Testbench with the ModelSim Simulator
To use the testbench with IP functional simulation models in the ModelSim simulator,
follow these steps:
1. Start the ModelSim simulator.
2. In the simulator, change the working directory to the location of the
<variation_name> _run_modelsim.tcl file.
3. To run the script type the following command at the simulator command prompt:
source < variation_name >_run_modelsim.tcl
Use the Testbench with NativeLink
To use the testbench with third-party IP functional simulation models using
NativeLink, follow these steps:
1. Create a new custom variation in your Quartus II project. Generate your
MegaCore function for this variation using the IP Toolbench.
2. Check that the absolute path to your third-party simulation tool is set. Set the path
from EDA Tool Options in the Options dialog box (Tools menu).
3. On the Processing menu, point to Start and click Start Analysis & Elaboration .
1
If the analysis and elaboration is not successful, fix the error before moving
to the next step.
4. On the Assignments menu, click Settings . The Settings dialog box appears.
Expand EDA Tool Settings and select Simulation .
POS-PHY Level 4 MegaCore Function User Guide
May 2013 Altera Corporation
相关PDF资料 |
PDF描述 |
|---|---|
| MAX6337US20D3+T | IC MPU/RESET CIRC 2.00V SOT143-4 |
| M3CWK-3436R | IDC CABLE - MKC34K/MC34M/MPL34K |
| M3AWK-3436R | IDC CABLE - MSC34K/MC34M/MPL34K |
| M3CKK-3436R | IDC CABLE - MKC34K/MC34M/MPK34K |
| M3AKK-3436R | IDC CABLE - MSC34K/MC34M/MPK34K |
相关代理商/技术参数 |
参数描述 |
|---|---|
| IPR-QDRII/UNI | 功能描述:开发软件 QDRII SRAM Control MegaCore RENEWAL RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IPR-RAPIDIOII | 功能描述:开发软件 RapidIO 1x/2x/4x MegaCore RENEWAL RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IPR-RIOPHY | 功能描述:开发软件 RapidIO MegaCore RENEWAL RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IPR-RLDII/UNI | 功能描述:开发软件 RLDRAM II Controller MegaCore RENEWAL RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IPR-RLDRAMII | 功能描述:开发软件 RLDRAM II Controller MegaCore RENEWAL RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
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