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参数资料
| 型号： | IPR-POSPHY4 |
| 厂商： | Altera |
| 文件页数： | 123/144页 |
| 文件大小： | 0K |
| 描述： | IP POS-PHY L4 RENEW |
| 标准包装： | 1 |
| 系列： | * |
| 类型： | MegaCore |
| 功能： | POS-PHY 4 级接口，链路层/物理层 |
| 许可证： | 续用许可证 |
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Appendix D: Board Design
Design for Testability
SPI-4.2 Status Interface
D–3
■
■
tstat[1:0]
tsclk
Other Useful Debug Signals
■
■
■
■
■
FPGA reset
stat_ts_sync
err_ts_dip2
err_ts_frm
trefclk
1
In addition to these transmitter signals, it may be useful to provide test points for
similar debug and status signals from the adjacent device.
Spare Pins
The SignalProbe feature in the Quartus II software allows you to route signals inside
the device to output pins so you can view the signals on an oscilloscope or logic
analyzer, without recompiling the design.
Altera recommends that you have a set of unused FPGA pins connected to test points
or connectors for an oscilloscope or logic analyzer. If you find problems in the design,
you can easily route internal signals to these connectors or test points to accelerate
debugging.
The following are SignalProbe feature requirements:
■
■
Pins for analysis must not already be assigned for use in the design, cannot be a
group or bus, and cannot have a carry or cascade fan out.
Nodes for analysis must be post-compilation, and cannot be carry-out or cascade-
out signals or groups.
f For more information on using the SignalProbe feature, refer to “Performing a
SignalProbe Compilation on a Design” in Quartus II Help.
JTAG Scan Chain
Altera recommends that you make the JTAG scan chain available for the Altera
SignalTap II logic analyzer. The SignalTap II application implements a small logic
analyzer inside the FPGA, and uses memory blocks to store waveforms. The
waveforms are sent via the JTAG interface to the SignalTap waveform viewer
application, allowing you to see what is happening inside the device.
May 2013
Altera Corporation
POS-PHY Level 4 MegaCore Function User Guide
相关PDF资料 |
PDF描述 |
|---|---|
| MAX6337US20D3+T | IC MPU/RESET CIRC 2.00V SOT143-4 |
| M3CWK-3436R | IDC CABLE - MKC34K/MC34M/MPL34K |
| M3AWK-3436R | IDC CABLE - MSC34K/MC34M/MPL34K |
| M3CKK-3436R | IDC CABLE - MKC34K/MC34M/MPK34K |
| M3AKK-3436R | IDC CABLE - MSC34K/MC34M/MPK34K |
相关代理商/技术参数 |
参数描述 |
|---|---|
| IPR-QDRII/UNI | 功能描述:开发软件 QDRII SRAM Control MegaCore RENEWAL RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IPR-RAPIDIOII | 功能描述:开发软件 RapidIO 1x/2x/4x MegaCore RENEWAL RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IPR-RIOPHY | 功能描述:开发软件 RapidIO MegaCore RENEWAL RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IPR-RLDII/UNI | 功能描述:开发软件 RLDRAM II Controller MegaCore RENEWAL RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IPR-RLDRAMII | 功能描述:开发软件 RLDRAM II Controller MegaCore RENEWAL RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
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