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参数资料
| 型号： | IPR-POSPHY4 |
| 厂商： | Altera |
| 文件页数： | 89/144页 |
| 文件大小： | 0K |
| 描述： | IP POS-PHY L4 RENEW |
| 标准包装： | 1 |
| 系列： | * |
| 类型： | MegaCore |
| 功能： | POS-PHY 4 级接口，链路层/物理层 |
| 许可证： | 续用许可证 |
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Chapter 5: Functional Description—Transmitter
Signals
Table 5–3. SPI-4.2 Transmit Interface
.
5–17
tdclk
Signal
Direction
Output
Clock
Domain
Description
SPI-4.2 differential transmit clock. Double-data rate clock
synchronous to tctl and tdat .
SPI-4.2 differential transmit control. When set to logic 1, the word
tctl
Output
tdclk
on tdat is a control word. When set to logic 0, the word on tdat
is a payload word.
tdat[15:0]
Output
SPI-4.2 differential transmit data bus. Bus carries packet/cell
payload or in-band control words.
tsclk
tstat[1:0]
Input
Input
tsclk
tsclk
(either edge)
SPI-4.2 transmit status clock. All signals infixed by _ts_ are
synchronous to this clock.
SPI-4.2 transmit status channel. Indicate the downstream device’s
FIFO buffers fill levels to the upstream device’s scheduler.
Table 5–4. Global
Signal
trefclk
tdint_clk
txsys_clk
Direction
Input
Output
Input
Clock Domain
trefclk
tdint_clk
txsys_clk
Description
Transmitter reference clock. Typically route to LVDS PLL.
Signals infixed by _tr_ are synchronous to this clock.
Derived from trefclk . Signals infixed by _td_ are
synchronous to this clock.
System clock. Signals infixed by _ty_ are synchronous to
this clock.
Active low asynchronous reset to all internal logic, including
txreset_n
Input
txinfo_aot[12:0]
stat_tx_pll_locked
ctl_tx_pll_areset
May 2013
Altera Corporation
Output
Output
Input
Static
Asynchronous
Fixed output information signal that contains the value for the
current AOT number for the release.
Locked signal directly from fast PLL in ALTLVDS for full rate
variations. Absent in quarter-rate variations.
Asynchronous reset signal directly to fast PLL in ALTLVDS for
full-rate variations. Absent in quarter-rate variations.
POS-PHY Level 4 MegaCore Function User Guide
相关PDF资料 |
PDF描述 |
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| MAX6337US20D3+T | IC MPU/RESET CIRC 2.00V SOT143-4 |
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相关代理商/技术参数 |
参数描述 |
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| IPR-RLDRAMII | 功能描述:开发软件 RLDRAM II Controller MegaCore RENEWAL RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
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