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参数资料
| 型号： | IPR-POSPHY4 |
| 厂商： | Altera |
| 文件页数： | 95/144页 |
| 文件大小： | 0K |
| 描述： | IP POS-PHY L4 RENEW |
| 标准包装： | 1 |
| 系列： | * |
| 类型： | MegaCore |
| 功能： | POS-PHY 4 级接口，链路层/物理层 |
| 许可证： | 续用许可证 |
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Chapter 5: Functional Description—Transmitter
Signals
Table 5–8. Data Path and Control Status (Part 2 of 2)
5–23
Signal
Direction
Clock Domain
Description
Number of training pattern sequence repetitions. This
value only applies to interval training patterns. If a
training pattern is inserted due to stat_ts_sync
ctl_td_alpha[7:0]
Input
deasserted, the training pattern lasts until
stat_ts_sync is asserted, and the current 20-cycle
training pattern completes. Setting to zero results in
an ALPHA of 256. Only change at reset.
For the individual buffers mode, this input sets the
■
legal burst unit size, formerly known as burst
length. A burst must end on either a non-zero
multiple of ctl_td_burstlen , or on an EOP.
tdint_clk
■
For the shared buffer with embedded addressing
mode, this input only limits when the MegaCore
function may read data from the buffer. This input
ctl_td_burstlen[9:0]
ctl_td_burstlimit[10:0]
Input
Input
enables delineating bursts, as in the individual
buffers case, only if the user logic pushes bursts
into the buffer with the desired delineation.
In either mode, this input also delays insertion of
■
training patterns after MaxT so that bursts are not
interrupted.
Units are in bytes. Supports M to 1,024 bytes in
■
increments of M, where M equals 16 or 32 bytes
depending on the Atlantic buffer width.
Sets the maximum burst size to be sent by the
transmitter. A control word is inserted at the end of
the burst limit. Burst limit values are restricted to
multiples of burst unit size (set via
ctl_td_burstlen[9:0] ), and depending on other
transmitter parameters, the values may be limited to
a minimum value. You can use IP Toolbench to
determine the valid values (set Parameter Type to
Fixed Value to determine the valid values, and then
set back to Real Time Programmable ). The units are
in bytes.
May 2013
Altera Corporation
POS-PHY Level 4 MegaCore Function User Guide
相关PDF资料 |
PDF描述 |
|---|---|
| MAX6337US20D3+T | IC MPU/RESET CIRC 2.00V SOT143-4 |
| M3CWK-3436R | IDC CABLE - MKC34K/MC34M/MPL34K |
| M3AWK-3436R | IDC CABLE - MSC34K/MC34M/MPL34K |
| M3CKK-3436R | IDC CABLE - MKC34K/MC34M/MPK34K |
| M3AKK-3436R | IDC CABLE - MSC34K/MC34M/MPK34K |
相关代理商/技术参数 |
参数描述 |
|---|---|
| IPR-QDRII/UNI | 功能描述:开发软件 QDRII SRAM Control MegaCore RENEWAL RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IPR-RAPIDIOII | 功能描述:开发软件 RapidIO 1x/2x/4x MegaCore RENEWAL RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IPR-RIOPHY | 功能描述:开发软件 RapidIO MegaCore RENEWAL RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IPR-RLDII/UNI | 功能描述:开发软件 RLDRAM II Controller MegaCore RENEWAL RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IPR-RLDRAMII | 功能描述:开发软件 RLDRAM II Controller MegaCore RENEWAL RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
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