- 您现在的位置：买卖IC网 > PDF目录16067 > IPR-POSPHY4 (Altera)IP POS-PHY L4 RENEW PDF资料下载
参数资料
| 型号： | IPR-POSPHY4 |
| 厂商： | Altera |
| 文件页数： | 138/144页 |
| 文件大小： | 0K |
| 描述： | IP POS-PHY L4 RENEW |
| 标准包装： | 1 |
| 系列： | * |
| 类型： | MegaCore |
| 功能： | POS-PHY 4 级接口，链路层/物理层 |
| 许可证： | 续用许可证 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页当前第138页第139页第140页第141页第142页第143页第144页
G–4
Appendix G: Conversion from v2.2.x
Transmitter Signals
Table G–1. Receiver Signal Changes (Part 3 of 3)
Version 2.4.x and 2.3.x Signal
Name
stat_rd_dip4_oos
err_rd_dip4
err_rd_pr
err_rd_tp
err_rd_sob
err_rd_sop8
err_rd_eightn
err_rd_abuf_oflw
ctl_rd_abuf_flush
err_ry_paddr
–
–
–
–
–
Version 2.2.x Signal Name
stat_rr_rx_dip4_oos
err_rr_dip4
err_rr_pr
err_rr_tp
err_rr_sob
err_rr_sop8
err_rr_eightn
err_rr_prbuf_oflw
ctl_rr_pbuf_flush
err_rr_paddr
err_rr_rxintfifo_oflw
ctl_rr_pbuf_threshold_high
ctl_rr_pbuf_threshold_low
stat_rr_pbuf_level
stat_a0_rxintfifo_empty
Notes
No change.
In version 2.2.x, this signal is in the rrefclk
domain; in version 2.3.0, this signal is in the
rxsys_clk domain.
Removed from Signals table.
Transmitter Signals
In the 2.2.x versions of the MegaCore function, data is written to the Atlantic FIFO
buffers using the Atlantic clock ( aN_atxclk ). The logic, and reading from the Atlantic
FIFO buffer, is synchronous to trefclk / tx_coreclock (transmit clock). The SPI-4.2
transmit clock, tdclk , is generated from trefclk . Signals synchronous to trefclk are
infixed by _tc_ . The status processor is synchronous to tsclk . Signals synchronous to
tsclk are infixed by _ts_ . The external status signals in the shared buffer with
embedded addressing mode are synchronous to the Atlantic clock, a0_txclk .
In the 2.4.x and 2.3.x versions, the logic is synchronous to tdint_clk . The tdint_clk
clock is derived from trefclk . Signals synchronous to tdint_clk are infixed by _td_ .
Reading from the Atlantic FIFO buffer is always done using tdint_clk . In the single
clock domain mode, writing to the Atlantic FIFO buffer is synchronous to tdint_clk .
In the multiple clock domain mode, writing to the Atlantic FIFO buffer uses
aN_atxclk . For more information, refer to the “Clock Structure” section of the
“Functional Description—Transmitter” chapter.
In 2.4.x and 2.3.x versions of the MegaCore function, the status processor is
synchronous to tsclk ; however, the external status signals are in the txsys_clk
domain. The txsys_clk clock is an input to the MegaCore function, and may be set to
tsclk . Signals synchronous to tsclk are infixed by _ts_ , and signals synchronous to
txsys_clk are infixed by _ty_ .
POS-PHY Level 4 MegaCore Function User Guide
May 2013 Altera Corporation
相关PDF资料 |
PDF描述 |
|---|---|
| MAX6337US20D3+T | IC MPU/RESET CIRC 2.00V SOT143-4 |
| M3CWK-3436R | IDC CABLE - MKC34K/MC34M/MPL34K |
| M3AWK-3436R | IDC CABLE - MSC34K/MC34M/MPL34K |
| M3CKK-3436R | IDC CABLE - MKC34K/MC34M/MPK34K |
| M3AKK-3436R | IDC CABLE - MSC34K/MC34M/MPK34K |
相关代理商/技术参数 |
参数描述 |
|---|---|
| IPR-QDRII/UNI | 功能描述:开发软件 QDRII SRAM Control MegaCore RENEWAL RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IPR-RAPIDIOII | 功能描述:开发软件 RapidIO 1x/2x/4x MegaCore RENEWAL RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IPR-RIOPHY | 功能描述:开发软件 RapidIO MegaCore RENEWAL RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IPR-RLDII/UNI | 功能描述:开发软件 RLDRAM II Controller MegaCore RENEWAL RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IPR-RLDRAMII | 功能描述:开发软件 RLDRAM II Controller MegaCore RENEWAL RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
发布紧急采购，3分钟左右您将得到回复。