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参数资料
| 型号： | IPR-POSPHY4 |
| 厂商： | Altera |
| 文件页数： | 68/144页 |
| 文件大小： | 0K |
| 描述： | IP POS-PHY L4 RENEW |
| 标准包装： | 1 |
| 系列： | * |
| 类型： | MegaCore |
| 功能： | POS-PHY 4 级接口，链路层/物理层 |
| 许可证： | 续用许可证 |
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4–28
Chapter 4: Functional Description—Receiver
Signals
Table 4–9. SPI-4.2 Channel Control and Status (Part 3 of 3)
Signal
rav_clk
rav_address[3:0]
rav_chipselect
Direction Clock Domain
Input
Input
Input
Description
Avalon-MM clock. Signals prefixed with rav_ are
synchronous to this clock. This port is absent if
asymmetric port support is turned off.
Avalon-MM address. This port is absent if asymmetric
port support is turned off.
Avalon-MM chip select. This port is absent if
asymmetric port support is turned off.
rav_write
rav_read
rav_writedata[15:0]
rav_readdata[15:0]
rav_waitrequest
Input
Input
Input
Output
Output
rav_clk
Avalon-MM write enable. This port is absent if
asymmetric port support is turned off.
Avalon-MM read enable. This port is absent if
asymmetric port support is turned off.
Avalon-MM write data. This port is absent if asymmetric
port support is turned off.
Avalon-MM write data. This port is absent if asymmetric
port support is turned off.
Avalon-MM wait request. This port is absent if
asymmetric port support is turned off.
(1) The nominal phase offset between the clock and data is 180 ? , you may want to put some timing constraints between the clock and status block.
You must take into account the trace delay difference between the clock and status block, to compensate for any difference.
Table 4–10. DPA Control and Status
Signal
Direction
Clock Domain
Description
Error flag to indicate that the DPA circuitry
err_rd_dpa
stat_rd_dpa_locked
stat_rd_dpa_lvds_locked[16:0]
ctl_rd_dpa_force_unlock
POS-PHY Level 4 MegaCore Function User Guide
Output
Output
Output
Input
rdint_clk
could not find byte alignment. This port is
absent if DPA is turned off.
When this signal is high, it indicates that
the DPA aligner has aligned to the training
pattern. This port is absent if DPA is turned
off.
When this signal is high, it indicates that
the DPA PLL has locked. This port is absent
if DPA is turned off.
Forces the DPA circuitry and PLL to unlock
and retrain. This port is absent if DPA is
turned off.
May 2013 Altera Corporation
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