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参数资料
| 型号： | M66596WG |
| 元件分类： | 总线控制器 |
| 英文描述： | UNIVERSAL SERIAL BUS CONTROLLER, PBGA64 |
| 封装： | 0.80 MM PITCH, FBGA-64 |
| 文件页数： | 61/133页 |
| 文件大小： | 1611K |
| 代理商： | M66596WG |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页当前第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页
M66596FP/WG
rev .1.00
2006.3.14
page 31 of 127
<<Note>>
None in particular
Interrupt enabled register 1[INTENB1]
<Address: 32H>
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
BCHGE
DTCHE
SIGNE SACKE
BRDYM
INTL
PCSE
?
0
-
?
0
-
0
?
0
-
0
-
0
?
0
-
0
-
0
-
Bit
Name
Function
S/W
H/W
Note
15 Nothing is placed here. These should be fixed at “0”.
14 BCHGE
USB bus change interrupt enabled
0: Interrupt output disabled
1: Interrupt output enabled
R/W
R
13 Nothing is placed here. This should be fixed at “0”.
12 DTCHE
Full-Speed detach detect interrupt
enabled
0: Interrupt output disabled
1: Interrupt output enabled
R/W
R
11-6 Nothing is placed here. This should be fixed at “0”.
5
SIGNE
Setup transaction error detect interupt
enabled
0: Interrupt output disabled
1: Interrupt output enabled
R/W
R
4
SACKE
Setup transaction complete interrupt
enabled
0: Interrupt output disabled
1: Interrupt output enabled
R/W
R
3
Nothing is placed here. This should be fixed at “0”.
2
BRDYM
BRDY interrupt status clear timing control
0: Software clears BRDY interrupt status
1: The controller clears BRDY interrupt status
R/W
R
1
INTL
Interrupt output sensing control
0: Edge sensing
1: Level sensing
R/W
R
0
PCSE
returning fact selection from low-power
sleep mode
0: USB resume detectionm, VBUS interrupt
detection during suspend, or CS_N signal
input
1: USB resume detectionm, or VBUS interrupt
detection during suspend
R/W
R
<<Notes>>
*1) DTCHE, SIGNE, SACKE bit are effective only at the time of a Host mode.
*2) The DTCHE bit is effective only at the time of Full-Speed mode.
Please perform detach detection by S/W, such as detecting ignore packet from peripheral device at the time of
Hi-Speed mode.
*3) When software sets "BRDYM=1", it will set “INTL=1” also.
*4) PCSE bit shoud be set after “USBE=1” setting.
相关PDF资料 |
PDF描述 |
|---|---|
| M6XXLFXI | OTHER CLOCK GENERATOR, QCC16 |
| M300LFXIT | 50 MHz, OTHER CLOCK GENERATOR, QCC16 |
| M74HC00C1R | HC/UH SERIES, QUAD 2-INPUT NAND GATE, PQCC20 |
| M74HC157B1N | HC/UH SERIES, QUAD 2 LINE TO 1 LINE MULTIPLEXER, TRUE OUTPUT, PDIP16 |
| M74HC158C1 | HC/UH SERIES, QUAD 2 LINE TO 1 LINE MULTIPLEXER, INVERTED OUTPUT, PQCC20 |
相关代理商/技术参数 |
参数描述 |
|---|---|
| M66596WG#RB0Z | 制造商:Renesas Electronics 功能描述:Tray 制造商:Renesas 功能描述:0 |
| M6668 | 制造商:Tamura Corporation of America 功能描述: |
| M66700P | 制造商:MITSUBISHI 制造商全称:Mitsubishi Electric Semiconductor 功能描述:DUAL HIGH-SPEED CCD CLOCK DRIVER |
| M66700WP | 制造商:MITSUBISHI 制造商全称:Mitsubishi Electric Semiconductor 功能描述:DUAL HIGH-SPEED CCD CLOCK DRIVER |
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