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参数资料
| 型号： | CORE10/100-RM |
| 厂商： | Microsemi SoC |
| 文件页数： | 12/106页 |
| 文件大小： | 0K |
| 描述： | IP CORE10/100 ETHERNET MAC |
| 标准包装： | 1 |
| 系列： | * |
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Functional Block Descriptions
Transmit Data
RAM
CLKT
Core10100 v4.0
TLSM
TFIFO
TC
Transmit
RMII/MII
AHB
Interface
AHB
DMA
BD
MII to RMII
(optional)
RC
Receive
RMII/MII
External Address
RLSM
RFIFO
Receive Data
RAM
Address
RAM
Filtering Interface
CLKR
MII Managment
Interface
APB
Interface
APB
CSR
(control and status registers
and control logic)
TPS
RPS
Serial ROM
Interface
RSTC
Figure 1-2 · Core10100_AHBAPB Architecture
AHB – AHB Interface
The AHB block implements an AHB master function, allowing the DMA controller to access memory on the AHB
bus.
APB – APB Interface
This APB block implements an APB slave interface, allowing the CPU to access the CSR registers set.
12
v4.0
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