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参数资料
| 型号： | CORE10/100-RM |
| 厂商： | Microsemi SoC |
| 文件页数： | 61/106页 |
| 文件大小： | 0K |
| 描述： | IP CORE10/100 ETHERNET MAC |
| 标准包装： | 1 |
| 系列： | * |
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Core10100 v4.0
Internal Operation
Deferring
The deferment algorithm is implemented per the 802.3 specification and outlined in Figure 4-14 . The InterFrame Gap
(IFG) timer starts to count whenever the link is not idle. If activity on the link is detected during the first 60 bit times of
the IFG timer, the timer is reset and restarted once activity has stopped. During the final 36 bit times of the IFG timer,
the link activity is ignored.
Carrier sensing is performed only when operating in half-duplex mode. In full-duplex mode, the state of the CRS input
is ignored.
Reset IFG Timer
No
CRS = 0?
Yes
IFG Timer =
60 Bit Times?
Yes
IFG Timer =
No
No
96 Bit Times?
Yes
No
Transmit Ready and
Not in Backoff?
Yes
CRS = 0?
Yes
Transmit Frame
No
Figure 4-14 · Deferment Process Algorithms
v4.0
61
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