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参数资料
| 型号： | CORE10/100-RM |
| 厂商： | Microsemi SoC |
| 文件页数： | 96/106页 |
| 文件大小： | 0K |
| 描述： | IP CORE10/100 ETHERNET MAC |
| 标准包装： | 1 |
| 系列： | * |
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Transmit and Receive Functional Timing Examples
16-Bit Word Transfer from Receive Data RAM to Shared Memory
Core10100 v4.0
1.
2.
3.
4.
Core10100 writes the 64th byte of the frame into the Receive Data RAM.
Core10100 starts to send the data request to transfer received data into the shared memory.
The first 32-bit word is written into the shared memory via the data interface.
The 64th byte of the frame is written into the shared memory.
(3)
CLKDMA
CLKR
RWE
RRADDR[9:0] 000
(1)
(2)
00
RWADDR[9:0] 03F
040
041
042
RRDATA[15:0] 0000
DATAACK
DATAREQ
DATARW
DATAADDR[31:0] 00001014
DATAO[15:0] 0000
Figure B-17 · 16-Bit Word Transfer from Receive Data RAM to Shared Memory
8-Bit Word Transfer from Receive Data RAM to Shared Memory
CLKDMA
CLKR
RWE
(1)
(2)
(3)
RWADDR[10:0]
03E
03F
040
041
042
043
044
0
RRADDR[10:0] 000
RRDATA[7:0] 00
DATAACK
DATAREQ
DATAADDR[31:0] 00001014
DATAO[7:0] 00
Figure B-18 · 8-Bit Word Transfer from Receive Data RAM to Shared Memory
Core10100 Receive Descriptor Fetch
The receive descriptor fetch timing is essentially the same as the transmit descriptor fetch timing. In reality, transmit
descriptor fetches and receive descriptor fetches can happen mixed or alternately through the DMA interface. Refer to
96
v4.0
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