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参数资料
| 型号： | CORE10/100-RM |
| 厂商： | Microsemi SoC |
| 文件页数： | 95/106页 |
| 文件大小： | 0K |
| 描述： | IP CORE10/100 ETHERNET MAC |
| 标准包装： | 1 |
| 系列： | * |
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Core10100 v4.0
Core10100 Receives and Writes 8-Bit Receive Data RAM
Receive Examples
1.
2.
3.
4.
Core10100 starts to receive the preamble.
Core10100 starts to receive the packet.
Core10100 starts to write the first 8-bit word into the receive FIFO.
Core10100 starts to write the second 8-bit word into the receive FIFO.
Note: t0 = 16 × CLKR period, t1 = 2 × CLKR period.
(4)
CLKR
RX_DV
RWE
(1)
t 0
(2)
(3)
t 1
RXD[3:0] 0
RWADDR[10:0] 000
RWDATA[7:0] F0
5
F5
01 234 5678
Figure B-15 · Core10100 Receives and Writes 8-Bit Receive Data RAM
Transfer Receive Data to Shared Memory
32-Bit Word Transfer from Receive Data RAM to Shared Memory
1.
2.
3.
4.
Core10100 writes the 64th byte of the frame into the Receive Data RAM.
Core10100 starts to send the data request to transfer received data into the shared memory.
The first 32-bit word is written into the shared memory via the data interface.
The 64th byte of the frame is written into the shared memory.
Note: t0 = 6 × CLKDMA period.
(3)
CLKDMA
CLKR
RWE
(1)
t 0
(2)
(4)
RWADDR[8:0]
RRADDR[8:0] 000
00E 00F 010
0
RRDATA[31:0] 76543210
DATAACK
DATAREQ
DATAADDR[31:0] 00001014
DATAO[31:0] 76543210
Figure B-16 · 32-Bit Word Transfer From Receive Data RAM to Shared Memory
v4.0
95
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