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参数资料
| 型号： | CORE10/100-RM |
| 厂商： | Microsemi SoC |
| 文件页数： | 93/106页 |
| 文件大小： | 0K |
| 描述： | IP CORE10/100 ETHERNET MAC |
| 标准包装： | 1 |
| 系列： | * |
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Core10100 v4.0
Receive Examples
Receive Examples
Receive Dataflow Overview
Core10100 receives Ethernet data from the MII interface, and the Receive Controller writes the received data into the
Receive Data RAM. The RFIFO Controller for Core10100 starts to transfer received data from the Receive Data RAM
to the shared memory via the DMA unit when the data in the Receive Data RAM exceeds 64 bytes. Figure B-12 on
page 93 illustrates the received data travelling through different Core10100 interfaces. A typical receive consists of the
following steps (as shown in Figure B-12 on page 93 ):
1.
2.
3.
4.
Core10100 starts to receive the preamble and SFD.
Core10100 starts to write the receive data to the Receive Data RAM.
Core10100 writes the 64th byte of the received data to the receive FIFO.
Core10100 starts to transfer received data from the Received Data RAM to the shared RAM.
(4)
RX_DV
(1)
(2)
(3)
RXD[3:0] 0
5
0 0 0 0 0
0 0
0 0 0
0 0 0 0 0
0 0
RWE
RWADDR[8:0]
RRADDR[8:0]
DATAREQ
DATAACK
DATAADDR[31:0]
Figure B-12 · A Typical Receive Example
v4.0
93
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