- 您现在的位置：买卖IC网 > PDF目录16069 > CORE10/100-RM (Microsemi SoC)IP CORE10/100 ETHERNET MAC PDF资料下载
参数资料
| 型号： | CORE10/100-RM |
| 厂商： | Microsemi SoC |
| 文件页数： | 60/106页 |
| 文件大小： | 0K |
| 描述： | IP CORE10/100 ETHERNET MAC |
| 标准包装： | 1 |
| 系列： | * |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页当前第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页
Software Interface
Core10100 v4.0
Collision Handling
Collision detection is performed via the col input port. If a collision is detected before the end of the PREAMBLE/
SFD, Core10100 completes the PREAMBLE/SFD, transmits the JAM sequence, and initiates a backoff computation.
If a collision is detected after the transmission of the PREAMBLE and SFD, but prior to 512 bits being transmitted,
Core10100 immediately aborts the transmission, transmits the JAM sequence, and then initiates a backoff. If a collision
is detected after 512 bits have been transmitted, the collision is termed a late collision. Core10100 aborts the
transmission and appends the JAM sequence. The transmit message is flushed from the FIFO. Core10100 does not
initiate a backoff and does not attempt to retransmit the frame when a late collision is detected.
Core10100 uses a “truncated binary exponential backoff ” algorithm for backoff computing, as defined in the IEEE 802.3
Backoff processing is performed only in half-duplex mode. In full-duplex mode, collision detection is disabled.
Reset Attempt
Transmission
Ready
Yes
Wait for End of
Transmission
No
Normal
Collision?
No
Late Collision?
Y es
Set TDES0.9 (LC)
Late Collision
Yes
Increment Attempt
No
Attempt < 16
Yes
No
Set TDES0.8 (EC)
Excessive Collision
Yes
ran = random(0..2 attempt – 1)
Attempt < 10
No
ran = random(0..2 10 – 1)
Wait for ran * Slot Time
Next Transmission
Attempt
Figure 4-13 · Backoff Process Algorithms
60
v4.0
相关PDF资料 |
PDF描述 |
|---|---|
| M3CMK-2040K | IDC CABLE - MKC20K/MC20F/MCG20K |
| M3AMK-2040K | IDC CABLE - MSC20K/MC20F/MCG20K |
| M3UUK-4020K | IDC CABLE - MKS40K/MC40F/MKS40K |
| BQ26221PWG4 | IC BATTERY MONITOR HP 8-TSSOP |
| MAX6328UR29+T | IC MPU/RESET CIRC 2.93V SOT23-3 |
相关代理商/技术参数 |
参数描述 |
|---|---|
| CORE10GMAC-OM | 功能描述:HW/SW/OTHER 制造商:microsemi corporation 系列:* 零件状态:在售 标准包装:1 |
| CORE10GMAC-OMFL | 功能描述:HW/SW/OTHER 制造商:microsemi corporation 系列:* 零件状态:在售 标准包装:1 |
| CORE12X4 | 制造商:Bogen Communications 功能描述:12 X 4 MATRIX CONTROLLER |
| CORE1553BBC-AN | 功能描述:IP MODULE CORE1553 BUS CTLR RoHS:否 类别:编程器，开发系统 >> 软件 系列:* 标准包装:1 系列:ISE® 设计套件 类型:订阅 适用于相关产品:Xilinx FPGAs 其它名称:Q4986209T1081384 |
| CORE1553BBC-AR | 功能描述:IP MODULE CORE1553 BUS CTLR RoHS:否 类别:编程器，开发系统 >> 软件 系列:* 标准包装:1 系列:ISE® 设计套件 类型:订阅 适用于相关产品:Xilinx FPGAs 其它名称:Q4986209T1081384 |
发布紧急采购，3分钟左右您将得到回复。