参数资料
| 型号： | IP-POSPHY4 |
| 厂商： | Altera |
| 文件页数： | 130/144页 |
| 文件大小： | 0K |
| 描述： | IP POS-PHY L4 |
| 标准包装： | 1 |
| 系列： | * |
| 类型： | MegaCore |
| 功能： | POS-PHY 4 级接口，链路层/物理层 |
| 许可证： | 初始许可证 |
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F–2
Appendix F: Static and Dynamic Phase Alignment
Dynamic Alignment
Dynamic Alignment
Dynamic alignment allows for greater skew between the inputs. At the receiver, the
frequency (hence sampling rate) is known, but the actual phase of the data is not. Each
receiver channel looks onto the incoming data and samples at the center of the data
eye. Additional logic is required to account for the skews in sampling the data. These
skews arise when the data is realigned in time to reconstitute the data as it was
originally sent.
The timing margin for a dynamically-aligned system generally excludes the
differential skews between data signals. In this case, the timing margin is calculated
from the clock frequency by subtracting the receiver sampling window, jitter
components, and any sampling errors introduced into the receiver. Transmitter output
delays or skews, or interconnection skews can be ignored because the receiver ’s
dynamic phase aligner compensates for them.
Dynamic alignment is appropriate where the skews between signals cannot be
controlled, which is common where signals pass through multiple connectors, or
where devices can be interchanged. It typically provides a much larger timing margin
than static alignment.
Figure F–2 shows an example of dynamic alignment.
Figure F–2. Dynamic Alignment Timing Diagram
Clock
Data 1
Inferred
Sample Clock
Phase Aligned
Sample for
Data 1
Data 2
Phase Aligned
Sample for
Data 2
Phase Delay
Phase Delay
Altera Solutions
Altera supports both static and dynamic alignment as a system solution.
POS-PHY Level 4 MegaCore Function User Guide
May 2013 Altera Corporation
相关PDF资料 |
PDF描述 |
|---|---|
| IP-RIOPHY | IP RAPID I/O |
| IP-RLDRAMII | IP RLDRAM II CONTROLLER |
| IP-RSDEC | IP REED-SOLOMON DECODER |
| IP-SDI | IP VIDEO INTERFACE - SDI |
| IP-SDRAM/DDR2 | IP DDR2 SDRAM CONTROLLER |
相关代理商/技术参数 |
参数描述 |
|---|---|
| IPPS054193X | 功能描述:保险丝 800A 1000V 3GKN/75 RoHS:否 制造商:Littelfuse 产品:Surface Mount Fuses 电流额定值:0.5 A 电压额定值:600 V 保险丝类型:Fast Acting 保险丝大小/组:Nano 尺寸:12.1 mm L x 4.5 mm W 安装风格: 端接类型:SMD/SMT 系列:485 |
| IP-QDRII/UNI | 功能描述:开发软件 QDRII SRAM Control MegaCore RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IPR-100GEMAC | 功能描述:开发软件 100G Ethernet Mac MegaCore RENEWAL RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IPR-100GEMACPHY | 功能描述:开发软件 100 Gb Ethernet MAC PHY MegaCore RENEWAL RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IPR-100GEPHY | 功能描述:开发软件 100G Ethernet Phy MegaCore RENEWAL RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
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