参数资料
| 型号： | IP-POSPHY4 |
| 厂商： | Altera |
| 文件页数： | 64/144页 |
| 文件大小： | 0K |
| 描述： | IP POS-PHY L4 |
| 标准包装： | 1 |
| 系列： | * |
| 类型： | MegaCore |
| 功能： | POS-PHY 4 级接口，链路层/物理层 |
| 许可证： | 初始许可证 |
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4–24
Chapter 4: Functional Description—Receiver
Signals
Signals
Table 4–5 through Table 4–11 list the I/O signals used in the receiver MegaCore
function. The active low signals are suffixed by _n .
Table 4–5. SPI-4.2 Receive Interface
Signal
rdclk
Direction
LVDS Clock
Input
Clock Domain
Description
SPI-4.2 differential receive clock. Double-data rate clock
synchronous to rctl and rdat .
SPI-4.2 differential receive control.
rctl
LVDS Input
rdclk
When set to a logic 1, the word on rdat is a control word. When
set to a logic 0, the word on rdat is a payload word.
rdat[15:0]
LVDS Input
SPI-4.2 differential receive data bus. Bus carries packets/cells or
in-band control words.
SPI-4.2 receive status clock. This signal uses a regular LVTTL
rsclk
rstat[1:0]
LVTTL Output
LVTTL Output
rsclk
(rdint_clk)
data pin instead of a dedicated output clock pin. Derived from
rdclk . Active if rdclk is active.
SPI-4.2 receive status channel. Indicates the downstream
device’s FIFO buffers’ fill level to the upstream device’s scheduler.
Table 4–6. Global
Signal
rdint_clk
rxsys_clk
Direction
Output
Input
Clock Domain
rdint_clk
rxsys_clk
Description
Derived from rdclk . Signals infixed with _rd_ are
synchronous to this clock. Active if rdclk is active.
System clock. Signals infixed with _ry_ are synchronous to
this clock.
Active low asynchronous reset to all internal logic, including
rxreset_n
Input
rxinfo_aot[12:0]
stat_rx_pll_locked
Output
Output
Static
Asynchronous
Fixed output information signal that contains the current
AOT number for the release.
Locked signal directly from fast PLL in ALTVDS for full rate
variations, or enhanced PLL in quarter-rate variations.
Asynchronous reset signal directly to fast PLL in ALTVDS for
ctl_rx_pll_areset
Input
Asynchronous full rate variations, or enhanced PLL in quarter-rate
variations.
POS-PHY Level 4 MegaCore Function User Guide
May 2013 Altera Corporation
相关PDF资料 |
PDF描述 |
|---|---|
| IP-RIOPHY | IP RAPID I/O |
| IP-RLDRAMII | IP RLDRAM II CONTROLLER |
| IP-RSDEC | IP REED-SOLOMON DECODER |
| IP-SDI | IP VIDEO INTERFACE - SDI |
| IP-SDRAM/DDR2 | IP DDR2 SDRAM CONTROLLER |
相关代理商/技术参数 |
参数描述 |
|---|---|
| IPPS054193X | 功能描述:保险丝 800A 1000V 3GKN/75 RoHS:否 制造商:Littelfuse 产品:Surface Mount Fuses 电流额定值:0.5 A 电压额定值:600 V 保险丝类型:Fast Acting 保险丝大小/组:Nano 尺寸:12.1 mm L x 4.5 mm W 安装风格: 端接类型:SMD/SMT 系列:485 |
| IP-QDRII/UNI | 功能描述:开发软件 QDRII SRAM Control MegaCore RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IPR-100GEMAC | 功能描述:开发软件 100G Ethernet Mac MegaCore RENEWAL RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IPR-100GEMACPHY | 功能描述:开发软件 100 Gb Ethernet MAC PHY MegaCore RENEWAL RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IPR-100GEPHY | 功能描述:开发软件 100G Ethernet Phy MegaCore RENEWAL RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
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