参数资料
| 型号： | IP-POSPHY4 |
| 厂商： | Altera |
| 文件页数： | 96/144页 |
| 文件大小： | 0K |
| 描述： | IP POS-PHY L4 |
| 标准包装： | 1 |
| 系列： | * |
| 类型： | MegaCore |
| 功能： | POS-PHY 4 级接口，链路层/物理层 |
| 许可证： | 初始许可证 |
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5–24
Chapter 5: Functional Description—Transmitter
Avalon-MM Interface Register Map
Table 5–9. Scheduler Control and Status
Signal
Direction
Clock Domain
Description
Maximum number of bytes that can be transmitted when the
downstream FIFO buffer is starving. This number does not
ctl_td_mb1[10:0]
ctl_td_mb2[10:0]
Input
Input
tdint_clk
imply that a control word is inserted. Units are in bytes.
Supports 0 to 2,032 bytes in 16-byte increments. This port is
absent if you turn on Shared Buffer with Embedded
Addressing .
Maximum number of bytes that can be transmitted when the
downstream FIFO buffer is hungry. This number does not
imply that a control word is inserted. Units are in bytes.
Supports 0 to 2,032 bytes in 16-byte increments. This port is
absent if you turn on Shared Buffer with Embedded
Addressing .
This input determines the port switching behavior of the
scheduler.
The scheduler always makes a port switch decision when
■
ctl_td_burstlen data is sent, or when an EOP is sent.
Next credits are held in a table for all ports, and are
■
incremented by status updates.
Current credits are stored in a separate register for a single
■
port while it is serviced, and become stale because status
updates do not increment the value.
A port is only eligible for scheduling if there are greater
■
than or equal to ctl_td_burstlen next credits available,
and greater than or equal to ctl_td_burstlen data
available in the corresponding Atlantic FIFO buffer.
ctl_td_
switchmode[1:0]
Input -
Static reset
■
When ‘00’ (switch on EOP is turned off) the scheduler
switches when less than ctl_td_burstlen current
credits are available, or less than ctl_td_burstlen data
is available in the Atlantic buffer.
■
■
■
When ‘01’ (switch on EOP is turned on), the scheduler
switches when less than ctl_td_burstlen current
credits are available, or less than ctl_td_burstlen data
is available in the Atlantic buffer, or an EOP is sent.
When ‘10’ or ‘11’, the scheduler switches when
ctl_td_burstlen data is sent, or an EOP is sent.
In the IP Toolbench top-level file, the upper bit is always
tied to zero, and the lower bit is tied depending on the value
of the switch on end of packet feature. This port is absent if
you turn on Shared Buffer with Embedded Addressing .
Only change at reset.
Avalon-MM Interface Register Map
Table 5–10 lists the Avalon-MM interface registers.
POS-PHY Level 4 MegaCore Function User Guide
May 2013 Altera Corporation
相关PDF资料 |
PDF描述 |
|---|---|
| IP-RIOPHY | IP RAPID I/O |
| IP-RLDRAMII | IP RLDRAM II CONTROLLER |
| IP-RSDEC | IP REED-SOLOMON DECODER |
| IP-SDI | IP VIDEO INTERFACE - SDI |
| IP-SDRAM/DDR2 | IP DDR2 SDRAM CONTROLLER |
相关代理商/技术参数 |
参数描述 |
|---|---|
| IPPS054193X | 功能描述:保险丝 800A 1000V 3GKN/75 RoHS:否 制造商:Littelfuse 产品:Surface Mount Fuses 电流额定值:0.5 A 电压额定值:600 V 保险丝类型:Fast Acting 保险丝大小/组:Nano 尺寸:12.1 mm L x 4.5 mm W 安装风格: 端接类型:SMD/SMT 系列:485 |
| IP-QDRII/UNI | 功能描述:开发软件 QDRII SRAM Control MegaCore RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IPR-100GEMAC | 功能描述:开发软件 100G Ethernet Mac MegaCore RENEWAL RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IPR-100GEMACPHY | 功能描述:开发软件 100 Gb Ethernet MAC PHY MegaCore RENEWAL RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IPR-100GEPHY | 功能描述:开发软件 100G Ethernet Phy MegaCore RENEWAL RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
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