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参数资料
| 型号： | SIS600 |
| 厂商： | SILICON INTEGRATED SYSTEMS CORP |
| 元件分类： | 外设及接口 |
| 英文描述： | MULTIFUNCTION PERIPHERAL, PBGA487 |
| 封装： | BGA-487 |
| 文件页数： | 110/144页 |
| 文件大小： | 1592K |
| 代理商： | SIS600 |
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SiS600 Pentium II PCI /A.G.P. Chipset
Preliminary V1.0 Jan. 25, 1999
65
Silicon Integrated Systems Corporation
Register 34h
Capability Pointer (CAPPTR)
Default Value:
C0h
Access:
Read Only
The value of C0h indicates that the A.G.P. standard register block is located at Register C0h.
BIT
ACCESS
DESCRIPTION
7:0
RO
Capability Pointer
Pointer to the starting location of A.G.P. standard register block.
8.1.2. HOST CONTROL REGISTERS
Register 50h
Host Bus Interface control I
default Value:
02h
Access:
Read/Write
BIT
ACCESS
DESCRIPTION
7:4
R/W
Reserved
3
R/W
CPU-to-Memory and PCI-to-Memory Concurrency Enable
When enabled, CPU-to-Memory cycles and PCI-to-Memory cycles can take place
concurrently on the host bus and PCI bus. These two kinds of memory access
cycles will then be rearranged on the host bus and take place on the memory bus
sequentially. Bus utilization on both the host bus and PCI bus can be improved.
When disabled, the two kinds of cycles can not occur on CPU or PCI concurrently.
0: Disable
1: Enable
2
R/W
CPU-to-PCI and PCI-to Masters Concurrently Access PCI Bus Function
When enabled, CPU-to-PCI cycles and PCI-to-Memory can take place concurrently
on the host bus and PCI bus respectively, such that their respective cycles will be
forwarded to PCI bus and memory bus at the same time. This bit is valid only when
bit 3 is set. When disabled, the two kinds of cycles can not occur on the host bus
and PCI bus concurrently.
0: Disable
1: Enable
1
R/W
CPU Pipeline Function
When this bit is 0, only one pending cycle is allowed at one time. When this bit is
1, more than two pending cycles at one time are allowed subject to CPU’s
behavior.
0: no pipeline
1: pipeline enable
相关PDF资料 |
PDF描述 |
|---|---|
| SL15100ZC-XXX | 200 MHz, OTHER CLOCK GENERATOR, PDSO8 |
| SL15100ZI-XXX | 200 MHz, OTHER CLOCK GENERATOR, PDSO8 |
| SL18860DCT | 52 MHz, OTHER CLOCK GENERATOR, PDSO10 |
| SL28504RZC | OTHER CLOCK GENERATOR, PDSO64 |
| SL28504RLCT | OTHER CLOCK GENERATOR, QCC64 |
相关代理商/技术参数 |
参数描述 |
|---|---|
| SIS776DN | 制造商:VISHAY 制造商全称:Vishay Siliconix 功能描述:N-Channel 30 V (D-S) MOSFET with Schottky Diode |
| SIS776DN-T1-GE3 | 制造商:Vishay Siliconix 功能描述:MOSFET N-CH 30V 18.3A 1212-8 |
| SiS778DN-T1-GE3 | 功能描述:MOSFET 30 Volts 35 Amps 52 Watts RoHS:否 制造商:STMicroelectronics 晶体管极性:N-Channel 汲极/源极击穿电压:650 V 闸/源击穿电压:25 V 漏极连续电流:130 A 电阻汲极/源极 RDS（导通）:0.014 Ohms 配置:Single 最大工作温度: 安装风格:Through Hole 封装 / 箱体:Max247 封装:Tube |
| SIS780DN | 制造商:VISHAY 制造商全称:Vishay Siliconix 功能描述:N-Channel 30 V (D-S) MOSFET with Schottky Diode |
| SiS780DN-T1-GE3 | 功能描述:MOSFET 30 Volts 18 Amps 27.7 Watts RoHS:否 制造商:STMicroelectronics 晶体管极性:N-Channel 汲极/源极击穿电压:650 V 闸/源击穿电压:25 V 漏极连续电流:130 A 电阻汲极/源极 RDS（导通）:0.014 Ohms 配置:Single 最大工作温度: 安装风格:Through Hole 封装 / 箱体:Max247 封装:Tube |
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