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参数资料
| 型号： | IPR-SLITE2 |
| 厂商： | Altera |
| 文件页数： | 11/110页 |
| 文件大小： | 0K |
| 描述： | IP SERIALLITE II RENEW |
| 标准包装： | 1 |
| 系列： | * |
| 类型： | MegaCore |
| 功能： | SerialLite II 协议 |
| 许可证： | 续用许可证 |
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1–6
Chapter 1: About This MegaCore Function
Performance and Resource Utilization
Table 1–3. Performance for Stratix II GX (Part 2 of 2)
Packet
Type
M512
Data
Flow
Numbe
r of
Lanes
Data/
Type
Parameters
Transf
er Size
(1)
CR
C
Flow
Contr
ol
Retry-
on-
Error
Combi
n-
ational
ALUTs
Logic
Reg.
Memory
Blocks
M4
K
f MAX
(MHz)
Throughp
ut
Mbps (2)
Full-
Duplex
4
Packet
Priority
4
16
Yes
Yes
3528
2110
17
41
160
6375
(1) A transfer size of 1 is used for 1,250 Mbps, 2 is used for 3,125 Mbps, and 4 is used for 6,375 Mbps.
(2) Total throughput equals the value in the Throughput column multiplied by the value in the Number of Lanes column.
1,024-byte FIFO buffers. These results were obtained using the Quartus II software
version 10.1 for the following device: Stratix GX (EP1SGX40GF1020C5).
Table 1–4. Performance for Stratix GX (Part 1 of 3)
M4K
Data
Flow
Number
of
Lanes
Data Type
Parameters
Packet Transfer
Type Size (1)
CRC
Flow
Contro
l
Retry
- on-
Error
LEs
Memory
Blocks
M51
2
f MAX
(MHz)
Throughp
ut
Mbps (2)
Full-
Duplex
Full-
Duplex
Full-
Duplex
Full-
Duplex
Full-
Duplex
Full-
Duplex
Full-
Duplex
Full-
Duplex
Full-
Duplex
Full-
Duplex
Full-
Duplex
1
1
4
4
16
1
1
4
4
1
1
Packet
Packet
Packet
Packet
Packet
Packet
Packet
Packet
Packet
Packet
Packet
Data
Data
Data
Data
Data
Data
Data
Data
Data
Data
and
Priority
Data
and
Priority
1
2
1
2
2
1
2
1
2
2
2
No
No
No
No
No
32
32
32
32
No
32
No
No
No
No
No
Yes
Yes
Yes
Yes
Both
Both
No
No
No
No
No
No
No
No
No
No
No
1065
1098
1711
2706
8328
1687
1728
2496
3848
2169
2538
9
0
15
23
50
10
2
17
25
2
2
10
11
11
22
87
10
11
11
22
19
19
178
182
186
180
158
172
163
151
127
181
165
1250
3125
1250
3125
3125
1250
3125
1250
3125
3125
3125
SerialLite II MegaCore Function
User Guide
January 2014 Altera Corporation
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PDF描述 |
|---|---|
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参数描述 |
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