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参数资料
| 型号： | IPR-SLITE2 |
| 厂商： | Altera |
| 文件页数： | 44/110页 |
| 文件大小： | 0K |
| 描述： | IP SERIALLITE II RENEW |
| 标准包装： | 1 |
| 系列： | * |
| 类型： | MegaCore |
| 功能： | SerialLite II 协议 |
| 许可证： | 续用许可证 |
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Chapter 3: Parameter Settings
3–21
Link Layer Configuration
FIFO Buffer Size
Table 3–7. Factors Affecting Receive FIFO Buffer Size
Factor
Flow control
Pause duration
Number of packets (and
packet sizes)
Wire delay and bit rate
Description
If flow control is enabled, the FIFO buffer size should change to
account for the thresholds that must be set.
When optimizing against starvation during flow control, the pause
duration affects the FIFO buffer size.
If you want to use a store-and-forward FIFO (using the eop_dav
and a high threshold), the FIFO must be big enough to hold a full
packet at minimum.
The wire propagation delay and the bit rate change the wire latency,
which must be accommodated if flow control is used.
FIFO Buffer Structure
Figure 3–13. Atlantic FIFO Buffer Structure
Headroom
FTL/FTH
Threshold
Total
depth
Width s et automatically
The FIFO buffer threshold low (FTL), ctl_rxrdp_ftl/ctl_rxhpp_ftl, value for
receiver variations controls when the rxrdp_dav/rxhpp_dav signals are asserted for
the read side of the FIFO buffer, respectively. If the fill level of the buffer is higher than
the FTL value, the rxrdp_dav/rxhpp_dav signal is asserted indicating that there is a
burst of data available.
1
There is no requirement to wait for the rxrdp_dav/rxhpp_dav signal to be asserted;
you can read from the buffer at any time by asserting the rxrdp_ena/rxhpp_ena signal
at all times and qualifying the data with the rxrdp_val/rxhpp_val signal. The FIFO
buffer has built-in underflow protection, such that an underflow condition does not
exit.
January 2014
Altera Corporation
SerialLite II MegaCore Function
User Guide
相关PDF资料 |
PDF描述 |
|---|---|
| EBM28DRMN-S288 | CONN EDGECARD 56POS .156 EXTEND |
| RSM08DTKI-S288 | CONN EDGECARD 16POS .156 EXTEND |
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| ECM06DTMN-S273 | CONN EDGECARD 12POS R/A .156 SLD |
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相关代理商/技术参数 |
参数描述 |
|---|---|
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| IPR-SSIP | 功能描述:开发软件 Crypto Bundle BU Solution RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IPR-TRIETHERNET | 功能描述:开发软件 Triple Speed Ethernt MegaCore RENEWAL RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IPR-TRIETHERNETF | 功能描述:开发软件 3x Spd Ethernet MAC MegaCore RENEWAL RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IP-R-UNIV-CORE | 制造商:Brady Corporation 功能描述:UNIVERSAL RIBBON CORE; For Use With:Bradys IP Printer ;RoHS Compliant: NA |
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