参数资料
型号: S1C17554B00E10L
元件分类: 微控制器/微处理器
英文描述: 16-BIT, FLASH, 24 MHz, RISC MICROCONTROLLER, PBGA48
封装: 3.137 X 3.137 MM, 0.72 MM HEIGHT, 0.40 MM PITCH, WCSP-48
文件页数: 40/318页
文件大小: 2643K
代理商: S1C17554B00E10L
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14 WATCHDOG TIMER (WDT)
S1C17554/564 TECHNICAL MANUAL
Seiko Epson Corporation
14-1
Watchdog Timer (WDT)
14
WDT Module Overview
14.1
The S1C17554/564 includes a watchdog timer module (WDT) that uses the OSC1 oscillator as its clock source.
This timer is used to detect CPU runaway.
The features of WDT are listed below.
10-bit up counter
Either reset or NMI can be generated if the counter overflows.
Figure 14.1.1 shows the WDT configuration.
256 Hz
NMI
Reset
10-bit counter
Interrupt
control circuit
Run/Stop control
NMI/reset
mode select
WDTRUN[3:0]
WDTMD
Watchdog timer reset
WDTRST
Watchdog timer
CLG
OSC1
oscillator/divider
1.1 WDT Configuration
Figure 14.
The WDT module generates an NMI or reset (selectable via software) to the CPU if not reset within 131,072/fOSC1
seconds (4 seconds when fOSC1 = 32.768 kHz).
Reset WDT via software within this cycle to prevent NMI/resets, which in turn enables runaway detection for pro-
grams that do not pass through the handler routine.
Operation Clock
14.2
The WDT module uses the 256 Hz clock output by the CLG module as the operation clock. The CLG module
generates this operation clock by dividing the OSC1 clock into 1/128, resulting in a frequency of 256 Hz when
the OSC1 clock frequency is 32.768 kHz. The frequency described in this chapter will vary accordingly for other
OSC1 clock frequencies. The CLG module does not include a 256 Hz clock output control bit. The 256 Hz clock is
normally supplied to the WDT module when the OSC1 oscillation is on.
For detailed information on OSC1 oscillator control, see the “Clock Generator (CLG)” chapter.
WDT Control
14.3
NMI/Reset Mode Selection
14.3.1
WDTMD/WDT_ST register is used to select whether an NMI signal or a reset signal is output when WDT has not
been reset within the NMI/reset generation cycle.
To generate an NMI, set WDTMD to 0 (default). Set to 1 to generate a reset.
WDT Run/Stop Control
14.3.2
WDT starts counting when a value other than 0b1010 is written to WDTRUN[3:0]/WDT_CTL register and stops
when 0b1010 is written.
At initial reset, WDTRUN[3:0] is set to 0b1010 to stop WDT.
Since an NMI or reset may be generated immediately after running depending on the counter value, WDT should
also be reset concurrently (before running WDT), as explained in the following section.
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PDF描述
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S1C17564D00E199 16-BIT, FLASH, 24 MHz, RISC MICROCONTROLLER, UUC
S1C17651B00E199 16-BIT, FLASH, 2 MHz, RISC MICROCONTROLLER, PBGA
SPC563M54L3COBR 32-BIT, FLASH, 64 MHz, MICROCONTROLLER, PQFP100
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参数描述
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S1C17564 制造商:EPSON 制造商全称:EPSON 功能描述:16-bit Single Chip Microcontroller
S1C17564D111000 制造商:Epson Electronics America Inc 功能描述:16-bit, 128KB Flash (OSC3 = Ceramic)
S1C17564F111100 功能描述:显示驱动器和控制器 16-bit, 128KB Flash RoHS:否 制造商:Panasonic Electronic Components 工作电源电压:2.7 V to 5.5 V 最大工作温度: 安装风格:SMD/SMT 封装 / 箱体:QFN-44 封装:Reel
S1C17565 制造商:EPSON 制造商全称:EPSON 功能描述:16-bit Single Chip Microcontroller