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参数资料
| 型号： | AU1550500MBC |
| 厂商： | ADVANCED MICRO DEVICES INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 500 MHz, MICROPROCESSOR, PBGA483 |
| 封装： | 21 X 21 MM, 0.80 MM PITCH, PLASTIC, LBGA-483 |
| 文件页数： | 200/468页 |
| 文件大小： | 3308K |
| 代理商： | AU1550500MBC |
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AMD Alchemy Au1550 Security Network Processor Data Book
279
USB Device Controller
30283D
9.2.1.4
Endpoint Control-and-Status Registers
The endpoint control-and-status registers define parameters and reflect operational conditions for each endpoint.
usbd_ep0cs
Offset = 0x0024
Bit 31 30 29 28 27 26 25 24 23 22 21 20 19 18 17 16 15 14 13 12 11 10
9876543210
SU N
A
B
SZ
FS
Def. 00000000000000000000000000000000
usbd_ep1cs
Offset = 0x0028
usbd_ep2cs
Offset = 0x002C
Bit 31 30 29 28 27 26 25 24 23 22 21 20 19 18 17 16 15 14 13 12 11 10
9876543210
N
A
SZ
FS
Def. 00000000000000000000000000000000
usbd_ep3cs
Offset = 0x0030
usbd_ep4cs
Offset = 0x0034
Bit 31 30 29 28 27 26 25 24 23 22 21 20 19 18 17 16 15 14 13 12 11 10
9876543210
N
A
FS
Def. 00000000000000000000000000000000
Bits
Name
Description
R/W
Default
31:15
—
Reserved.
R/W
0
14
SU
Setup Received. Valid for endpoint 0 only. This bit is set when a SETUP
packet is received from the host.
R0
13
N
NAK. This bit is set when an operation does not complete successfully or
when data in a receive FIFO should be ignored. For most cases this
implies a returned NAK in response to a DATA packet or an incorrect CRC.
R0
12
A
ACK. This bit is set when an operation completes successfully. Most of the
time this means that the Host returned an ACK to a DATA (or SETUP)
packet or that a packet was received correctly and an ACK returned to the
Host.
Isochronous DATA and SETUP packets deviate from this model. For these
types of packets the A bit indicates successful transmission or reception
but no ACK is returned or expected.
R0
11
B
Alternate ACK. Valid for endpoint 0 only. Set when a DATA frame is cor-
rectly received on endpoint 0.
R0
10:1
SZ
Size. Valid for endpoints 0, 1, and 2 only. Specifies the data size of an IN
transfer.
R/W
0
FS
Force Stall. Setting this bit places the endpoint in a stalled condition. Any
transfer directed to the endpoint is answered with a STALL response.
STALL is typically used to indicate that the endpoint has halted. A CLEAR
FEATURE command received via the USB does not clear a stall condition
forced by this bit.
R/W
0
相关PDF资料 |
PDF描述 |
|---|---|
| AU1PDHM3/84A | 1 A, 200 V, SILICON, SIGNAL DIODE, DO-220AA |
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| AUH005A0F-SRZ | 1-OUTPUT 16.5 W DC-DC REG PWR SUPPLY MODULE |
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| AV-7248 | YIG TUNED OSCILLATOR, 2000 MHz - 8000 MHz |
相关代理商/技术参数 |
参数描述 |
|---|---|
| AU1550-500MBC AA | 制造商:Advanced Micro Devices 功能描述:176 BAL LPFBGA 13X13MM BD 制造商:Raza Microelectronics 功能描述:Raza Microelectronics AU1550-500MBC AA Co-Processors |
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