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参数资料
| 型号： | MT41J128M16HA-107:D |
| 元件分类： | DRAM |
| 英文描述： | 128M X 16 DDR DRAM, PBGA96 |
| 封装： | 9 X 14 MM, LEAD FREE, FBGA-96 |
| 文件页数： | 109/210页 |
| 文件大小： | 12448K |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页当前第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页第185页第186页第187页第188页第189页第190页第191页第192页第193页第194页第195页第196页第197页第198页第199页第200页第201页第202页第203页第204页第205页第206页第207页第208页第209页第210页
Table 88: Synchronous ODT Parameters
Symbol
Description
Begins at
Defined to
Definition for All
DDR3
Speed Bins
Units
ODTL on
ODT synchronous turn-on delay
ODT registered HIGH
RTT,on ±tAON
CWL + AL - 2
tCK
ODTL off
ODT synchronous turn-off delay
ODT registered HIGH
RTT,off ±tAOF
CWL +AL - 2
tCK
ODTH4
ODT minimum HIGH time after ODT
assertion or WRITE (BC4)
ODT registered HIGH or
write registration with ODT HIGH
ODT registered LOW
4tCK
tCK
ODTH8
ODT minimum HIGH time after
WRITE (BL8)
Write registration with ODT
HIGH
ODT registered LOW
6tCK
tCK
tAON
ODT turn-on relative to ODTL on
completion
Completion of ODTL on
RTT,on
See Table 56
ps
tAOF
ODT turn-off relative to ODTL off
completion
Completion of ODTL off
RTT,off
0.5tCK ± 0.2tCK
tCK
Figure 114: Synchronous ODT
T0
T1
T2
T3
T4
T5
T6
T7
T8
T9
CWL - 2
AL = 3
tAON (MAX)
tAOF (MAX)
T10
T11
T12
T13
T14
T15
CK
CK#
RTT
ODT
Don’t Care
Transitioning
RTT,nom
CKE
tAOF (MIN)
ODTL off = CWL + AL - 2
ODTL on = CWL + AL - 2
ODTH4 (MIN)
tAON (MIN)
Note: 1. AL = 3; CWL = 5; ODTL on = WL = 6.0; ODTL off = WL - 2 = 6. RTT,nom is enabled.
2Gb:
x4,
x8,
x16
DDR3
SDRAM
PDF:
09005aef826aaadc
2Gb_DDR3_SDRAM.pdf
–
Rev.
K
04/10
EN
197
Micron
Technology,
Inc.
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to
change
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or
specifications
without
notice.
2006
Micron
Technology,
Inc.
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PDF描述 |
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